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  • 本申请涉及显示技术领域,特别是一种薄膜晶体管及驱动电路、显示面板、显示装置。薄膜晶体管通过在基底层厚度方向设置至少第2半导体层,并由栅极同时控制第2半导体层和第1半导体层,使得工作时在第2半导体层和第1半导体层形成上下两个导电沟道,在平面上...
  • 本发明涉及试剂盒技术领域,具体涉及一种基于湿法转移工艺的MoS2背栅场效应晶体管及其制备方法,晶体管由硅基衬底、SiO2绝缘层、MoS2导电沟道层和Ag源漏电极从下至上依次设置构成;通过化学气相沉积(CVD)法制备高质量单层MoS2薄膜,采...
  • 在包括氧化物半导体膜的半导体装置中,提供一种包括电特性优良的晶体管的半导体装置。本发明是一种半导体装置,包括:第一导电膜;第一绝缘膜;氧化物半导体膜;第二导电膜;第二绝缘膜;第三导电膜;以及第四导电膜,其中氧化物半导体膜包括第一氧化物半导体...
  • 本申请实施例提供一种金属氧化物半导体元胞结构、功率芯片及制备方法,其中,金属氧化物半导体元胞结构,包括第一导电类型衬底、位于衬底上的第一导电类型外延层、形成于外延层中的第二导电类型有源区、形成于有源区中的第一导电类型的源极层;元胞结构还包括...
  • 本申请提供了一种宽禁带材料的垂直JFET器件及其制备方法。器件包括:元胞区沟槽;元胞区平台;多个过渡区沟槽;多个过渡区平台;源区,形成于元胞区平台的顶部;栅区,元胞区栅区形成于元胞区沟槽侧壁和底部的外延层中,过渡区栅区形成在过渡区沟槽侧壁和...
  • 本申请提供了一种宽禁带材料的沟槽型JFET器件及其制备方法。器件包括:元胞区沟槽;元胞区平台;多个过渡区沟槽;多个过渡区平台;源区,形成于元胞区平台的顶部;栅区,元胞区栅区形成于元胞区沟槽侧壁和底部的外延层中,过渡区栅区形成在过渡区沟槽侧壁...
  • 本申请属于半导体制造技术领域,提供一种超结功率器件的制备方法,方法包括:提供一衬底;在衬底上形成第一外延层;在第一外延层中形成若干彼此间隔设置的凹槽;在第一外延层上形成填充所述凹槽的第二外延层,并使第二外延层的生长速率沿衬底的中心向边缘的方...
  • 本发明提供一种半导体器件及其制作方法,所述方法包括:提供衬底,在所述衬底内形成凹槽,并封闭所述凹槽的开口以形成无介质隔离区;在所述衬底内形成浅沟槽隔离结构,所述无介质隔离区位于相邻所述浅沟槽隔离结构之间;对所述衬底进行阱离子注入,在相邻所述...
  • 本发明公开一种氮化物半导体器件,包括第一氮化物层,第一氮化物层为二元氮化合物;设置于第一氮化物层上的第二氮化物层;第二氮化物层由第一元素、第二元素、第三元素构成,第一元素为铝元素,第二元素为氮元素、第三元素为镓元素,沿着厚度方向第一元素的浓...
  • 本发明涉及半导体制造技术领域,特别涉及一种晶体管,该晶体管包括沟道层、势垒层、离子注入区、钝化层和欧姆电极。势垒层设置在沟道层上;离子注入区的第一区自势垒层的上表面向沟道层延伸并延伸至沟道层,第一区具有凹槽;第二区位于沟道层内并连通第一区;...
  • 本发明涉及一种绝缘体上硅半导体装置及其制造方法。上述半导体装置包括:基板;埋氧层,设置在上述基板上;第一器件区域及第二器件区域,设置在上述埋氧层上;沟槽,设置在上述第一器件区域与上述第二器件区域之间;器件隔膜,填充上述沟槽,对上述第一器件区...
  • 本发明涉及横向高电压半导体器件及其制造方法。半导体器件包括:有前侧和与前侧相对的后侧的半导体本体;半导体本体内的前侧处的器件区域,其中器件区域包括至少一个横向半导体元件;和在器件区域与后侧之间的第二导电类型的第一掺杂区域,其中第一掺杂区域与...
  • 本发明公开了一种半导体器件,所述半导体器件包括:半导体主体,所述半导体主体上形成有第一沟槽及第二沟槽;第一导电结构及第二导电结构;其中,所述第一导电结构的顶部为暴露于所述半导体主体之外的第一区域,所述第二导电结构的顶部为暴露于所述半导体主体...
  • 本申请公开了一种半导体器件、制备方法和集成电路,半导体器件包括:衬底,具有第一掺杂类型,具有第一表面和第二表面;第一阱区,位于第一表面且具有第一掺杂类型;第一掺杂区,包围并接触第一阱区,具有第二掺杂类型;第二阱区,位于第一表面且具有第一掺杂...
  • 本申请公开了一种半导体器件结构及其制备方法,涉及半导体器件技术领域,该半导体器件结构通过全环绕栅极结构、无结结构以及核‑壳导电沟道的协同作用,在保证无结结构统一的中高掺杂条件的同时,实现了导电沟道中核部的体导电路径和壳部的高迁移率导电路径的...
  • 本发明提供一种改善栅氧化层质量的方法,包括:提供衬底,在所述衬底上形成栅氧化层;对所述栅氧化层表面进行离子注入,注入的离子与所述栅氧化层的材料中所包含的半导体元素一致;在惰性气体以及氧气氛围下对所述栅氧化层进行快速热处理,使得所述栅氧化层内...
  • 本申请提供一种半导体器件及其制备方法、功率器件。该方法包括提供具有元胞区和终端区的基底,且具有多个第一栅极沟槽和多个第二栅极沟槽;形成层叠设置的第一介质层、第二介质层和第三介质层,第二介质层的材质为氮化硅;形成屏蔽栅;以第二介质层作为刻蚀停...
  • 本申请公开了一种半导体器件的制备方法和半导体器件,属于半导体制造技术领域。方法包括:制备第一中间体,第一中间体包括第一衬底,以及自第一衬底的一面依次层叠的第一介质层、第一功能层、第二介质层和第二衬底;剥离去除富离子层及位于富离子层第一侧的部...
  • 本发明公开一种沟槽栅电极自对准形成方法,包括:在半导体外延层漂移区上形成沟槽;在半导体外延层漂移区上、沟槽侧壁及之上,依次形成栅介质和栅电极,栅电极在沟槽中部形成小凹沟;在栅电极之上生长第一掩膜材料并刻蚀,在沟槽中部的小凹沟处残留有第一掩膜...
  • 本公开提供半导体装置和半导体装置的制造方法。半导体装置具有:基板,具有第一面和与所述第一面相对的第二面;第一氮化物半导体层,具有与所述第二面接触的第三面和与所述第三面相对的第四面,在所述第四面形成有凹部;第二氮化物半导体层,设于所述凹部;以...
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