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  • 本发明属于集成电路领域,公开了一种具有抗高dv/dt噪声且自适应功率管的电平移位器,所述电平移位器包括:一电平移位主体电路及一辅助上拉电路。本发明通过新增可根据功率管导通时间自适应地开启的辅助上拉电路,在片外采用不同功率管的应用场景下,均能...
  • 本发明提供一种抑制本振泄露的温度补偿方法、电路及装置,涉及温度补偿技术领域,该方法包括:通过热敏单元将调制器的实时温度转换为实时电压;基于所述实时电压与所述调制器对应的参考电压,对所述调制器进行温度补偿以抑制本振泄露。本发明在不需要外部处理...
  • 提供了一种电路,具有:第一输入端,配置为接收第一数据;第二输入端,耦接配置为接收第二数据;时钟输入端,配置为在第一时间段期间接收时钟信号,该时钟信号具有在第一时间段期间的触发沿;以及输出端。该电路配置为在第一时间段开始之前,通过输出端输出第...
  • 本申请公开了一种电子设备及其时钟发生器,应用于电路技术领域,包括:晶体振荡器;锁相环;用于按照寄存器模块的参数配置,进行时钟输出的时钟产生电路;用于在软掉电模式时,为通信电路和寄存器模块供电的供电电路;寄存器模块具有模式。在软掉电模式时通过...
  • 本申请公开了一种多环频率合成器,包括参考时钟电路、低频环和高频环;所述参考时钟电路包含第一本振和第二本振,所述第一本振用于为所述低频环和所述高频环提供基准频率,所述第二本振用于为所述低频环输出信号提供频率搬移;所述低频环为单环频率合成器,用...
  • 本申请公开了一种模拟数字转换器,属于集成电路领域。模拟数字转换器包括:第一电容阵列包括2N个第一电容组,第一电容组包括两个电容值为C的电容,第一电容组的初始状态为一个电容的开关连接接地端、另一个电容的开关连接参考电压端,第一电容阵列的上极板...
  • 本申请涉及一种基于FPGA的ADC校验装置及其检验方法,包括ADC板卡接口模块、时钟模块、FPGA模块、电源模块;ADC板卡接口模块的输出端连接FPGA模块;时钟模块的输出端连接FPGA模块;电源模块的输出端连接FPGA模块。实现了ADC采...
  • 本发明属于集成电路领域,具体为一种基于RRAM量化器和神经网络编码器的ADC电路。本发明采用OTA电路将输入电压转换为电流并输出至电流镜电路,多个比较裁决电路通过对比固定大小的充电电流与不同大小的放电电流的大小完成输入电压的量化,量化结果是...
  • 本发明属于集成电路领域,具体涉及一种基于RRAM延迟链和神经网络编码器的ADC。本发明首先利用延迟单元模块和RRAM延迟单元模块分别对输入信号进行处理,生成两类延时信号;以D触发器作为判决电路,当来自延迟单元的延时信号的上升沿到来时,D触发...
  • 本申请公开了一种传感器信号采样电路、方法及传感器,包括:第一放大模块,其输入端与传感器读头连接;模式切换开关,设置于第一放大模块的输出端;差分放大模块,其输出端与模数转换器的输入端连接;控制单元,其与模数转换器的输出端连接,控制单元还设有模...
  • 本发明公开了一种用于复合介质栅光敏探测器的乘累加读出电路及读出方法。该电路包括第一钳位电流镜、第二钳位电流镜、跨导放大器、乘累加电容阵列和模数转换电路。其中,通过第一钳位电流镜和第二钳位电流镜对正负器件列器件的漏端进行电压钳位,并对输出电流...
  • 本发明公开了一种集成迟滞电压控制的R‑2R数模转换器电路,涉及集成电路设计技术领域,包括:运算放大器,包括接收门限电压的同相输入端、接收测试电压的反相输入端和输出比较电压的输出端;R2R电阻网络,包括与运算放大器的同相输入端相连的输出门限电...
  • 本申请实施例公开了一种层级关系数据的压缩方法、解压方法及系统。本申请实施例提供的技术方案,通过获取原始层级关系数据集合,原始层级关系数据集合包括多条按照层级关系排序的原始编码数据;确定原始层级关系数据集合中各个原始编码数据的层级关联信息;基...
  • 本申请实施例提供了一种面向GPU设备的基于上下文建模的压缩方法及相关设备,用于提高上下文建模的压缩速率。本申请实施例方法包括:获取待压缩的输入数据,将待压缩的输入数据划分为预学习块和至少一个独立数据块;于GPU内存中初始化所有预测模型及所有...
  • 本发明公开了字节级并行的上下文混合压缩方法及系统,属于数据压缩领域,包括:按字节划分处理单元,对于每一个字节,将每个比特分别与选定的各个上下文模型进行绑定,并生成访问矩阵;访问矩阵记录各上下文模型对各比特进行预测时所映射的历史状态索引;根据...
  • 一种信息处理方法和装置,编码或译码使用的第一LDPC基图是从与第一条件匹配的LDPC基图集合中选择得到的,与第一条件相匹配的是LDPC基图集合,而不是一个LDPC基图,这样在第一条件下可以进行更灵活地选择LDPC基图,并且可以支持多种设备能...
  • 本发明提供了一种5GLDPC码分层调度译码方法,包括:步骤1,设定和分别表示为校验矩阵PCM 中的第i个检查节点和第j个变量节点;设和分别为第t次迭代中从传递到的校验至变量消息和从传递到的变量至校验消息;表示第t次迭代中第j个编码比特的后验...
  • 本发明涉及信道编码领域,公开了一种基于强化学习的极化码构造方法、系统、终端及存储介质,方法包括:将极化码构造过程建模为在二维网格上的迷宫遍历任务,在任务的每一个移动步骤中,根据智能体的当前状态选择一个移动动作分配信息比特或冻结比特,以形成部...
  • 本发明提供一种针对双纠错BCH和RS码解码的快速求根方法及装置,包括:步骤S1,预计算有限域的元素,获取二进制的矩阵;步骤S2,将矩阵转换为行最简形,记录对应的行变换矩阵,满足;步骤S3,通过输入部件输入预计算获取的行变换矩阵和矩阵的全零行...
  • 本发明公开了一种基于ARP交织器和SOVA算法的Turbo编译码方法及系统,在Turbo编译码系统的编码和译码端,运用SOVA算法,削减整体计算量与资源消耗,促使Turbo编译码系统更优地契合低轨卫星通信等应用场景,提升服务质量;借助ARP...
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