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龙图腾网获悉中国电子科技集团公司第五十八研究所申请的专利一种应用于宽带锁相环的高精度小数分频器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116112010B 。

龙图腾网通过国家知识产权局官网在2026-05-12发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310088124.9，技术领域涉及：H03L7/18；该发明授权一种应用于宽带锁相环的高精度小数分频器是由沈剑;范海宇;杨俊浩;秦战明;孙文俊设计研发完成，并于2023-02-09向国家知识产权局提交的专利申请。

本一种应用于宽带锁相环的高精度小数分频器在说明书摘要公布了：本发明公开一种应用于宽带锁相环的高精度小数分频器，属于数字电路领域，包括45双模分频器模块、19bit可编程计数器模块和可编程Σ‑Δ调制器模块；45双模分频器模块根据19bit可编程计数器模块生成的MC信号控制45分频比的切换，对VCO的输出信号进行预分频；19bit可编程计数器模块接45双模预分频时钟信号，通过19bit配置数控制分频比生成最终的分频信号；可编程Σ‑Δ调制器模块中，32bit小数配置输入FnumFden通过调制器调制，转化为一系列输出序列，与整数部分PLL_N相加进入19bit可编程计数器模块中，生成随机变化的瞬时分频比，这些瞬时分频比的平均值即最终小数分频比的值。本发明可实现对7.5GHz～15GHz的输入信号进行高精度的小数分频，步进可达0.047Hz，同时保证锁相环系统有较低的小数杂散。

本发明授权一种应用于宽带锁相环的高精度小数分频器在权利要求书中公布了：1.一种应用于宽带锁相环的高精度小数分频器，其特征在于，包括45双模分频器模块、19bit可编程计数器模块和可编程Σ-Δ调制器模块； 所述45双模分频器模块，根据后级19bit可编程计数器模块生成的MC信号控制45分频比的切换，对VCO的输出信号进行预分频； 所述19bit可编程计数器模块接45双模预分频时钟信号，通过19bit配置数控制分频比生成最终分频信号； 所述可编程Σ-Δ调制器模块中，32bit小数配置输入FnumFden通过调制器调制，转化为一系列输出序列，这些输出序列与整数部分PLL_N相加进入所述19bit可编程计数器模块中，生成随机变化的瞬时分频比，这些瞬时分频比的平均值即最终小数分频比的值； 所述45双模分频器模块包括3个级联的全差分CML的D触发器，第一个和第二个为嵌入与门逻辑的D触发器；VCO经过缓冲器的输出信号finP接3个D触发器的时钟CLK端口，VCO经过缓冲器的反相输出信号finN接3个D触发器的反向时钟CLKn端口； 第一个D触发器的输入为端口A和B的与，端口A接第三个D触发器的正向输出Q，端口B连接控制信号MC； 第二个D触发器的输入端A连接第三个D触发器的反向输出端QN，输入端B连接第一个D触发器的反向输出端QN； 第三个D触发器的输入端D连接第二个D触发器的正向输出端Q；第三个D触发器的输出端Q和QN的输出为经过45双模分频之后的一对差分信号Fpre_p和Fpre_n； 所述19bit可编程计数器模块包括17bit脉冲计数器和2bit同步可编程计数器；其中所述17bit脉冲计数器由17个带置位端的ECL2分频器和计数终止检测电路构成； 双模分频信号Fpre进入第一个ECL2分频器的时钟端，从第一级开始，后面每一级的输出端依次连接下一级的时钟输入端；可编程控制位DIV_N18:2分别依次连接17个ECL2分频器的置数端PI；17个ECL2分频器的反向输出端QN均依次连接计数终止检测逻辑电路的输入端，用来检测每个QN的状态；计数终止检测逻辑电路的输出信号LD连接17个ECL2分频器的置位端和2bit同步可编程计数器中的两个2选1选择器的选择端； 可编程控制位DIV_N1和DIV_N0的同或进入第一个2选1选择器的A1端，DIV_N1进入第二个2选1选择器的A0端；两个2选1选择器的输出分别接两个D触发器的数据D端，双模分频信号Fpre接该两个D触发器的时钟端；第二个D触发器的输出Q端连接第一个2选1选择器的A0端；第一个D触发器的反向输出QN端和第二个D触发器的输出Q端相与后，其输出接到第二个2选1选择器的A1端；第一个D触发器的输出Q端和第二个D触发器的输出Q端相或生成MC信号控制前面45分频的切换。

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