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龙图腾网获悉杭州芯旗电子技术有限公司申请的专利基于FPGA的多模板的五元组规则匹配方法及装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121357147B 。

龙图腾网通过国家知识产权局官网在2026-04-14发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511871967.1，技术领域涉及：H04L61/255；该发明授权基于FPGA的多模板的五元组规则匹配方法及装置是由马彬设计研发完成，并于2025-12-11向国家知识产权局提交的专利申请。

本基于FPGA的多模板的五元组规则匹配方法及装置在说明书摘要公布了：本申请公开了一种基于FPGA的多规则模板的五元组规则匹配方法及装置，通过高带宽内存存储多个规则模板，将规则模板进行级联，对待处理报文中的五元组信息进行规则匹配时，采用将规则模板进行非级联级联的方式进匹配，以获取待处理报文的动作策略。本申请每个模板匹配信息灵活可配，通过模板间级联实现复杂匹配功能，有效减少模板数量，降低系统资源。

本发明授权基于FPGA的多模板的五元组规则匹配方法及装置在权利要求书中公布了：1.一种基于FPGA的多规则模板的五元组规则匹配方法，其特征在于，所述FPGA包括高带宽内存HBM，所述HBM包括多个存储区，所述多个存储区中的任一个存储区被配置为所述多规则模板中的任一个规则模板，所述存储区中的存储地址存储相应的规则模板中的一条规则配置信息，所述规则配置信息包括掩码五元组、优先级和动作，所述方法包括： 获取待处理报文中的五元组信息； 针对每一个规则模板，将所述五元组信息与该规则模板对应的模板掩码相与后获得掩码后的五元组，对该掩码后的五元组进行哈希运算后，得到对应的哈希值； 针对每一个哈希值，以该哈希值作为相应存储区的存储地址，将所述五元组信息与该存储地址对应的掩码五元组执行规则匹配，以输出该规则模板所对应的匹配结果，所述匹配结果携带有未命中、非级联命中指示、规则池级联命中指示、相同规则号级联命中指示中的至少之一； 针对所获取的各个规则模板所对应的各个匹配结果，其中， 若存在多个携带有非级联命中指示的匹配结果的情况，获取优先级最高的掩码五元组所对应的第一动作； 若存在多个携带有规则池级联命中指示的匹配结果的情况，将具有级联匹配关系的第一掩码五元组和第二掩码五元组进行匹配查找，获取对应的第二动作； 若存在多个携带有相同规则号级联命中指示的匹配结果的情况，响应于相同规则号码的多个掩码五元组，获取优先级最高的掩码五元组所对应的第三动作； 从所述第一动作、第二动作和第三动作中，选择优先级最高的动作作为所述待处理报文的报文处理动作； 其中，所述FPGA还包括第一片内存储区、第二片内存储区和第三片内存储区，所述第一片内存储区和第二片内存储区的深度相同，所述第三片内存储区的深度大于所述第一片内存储区； 针对所述第一片内存储区的每一个存储地址，在该存储地址对应的存储空间配置第一级联池所对应的处理动作，并以该存储地址作为第一级联池所对应的第一存储地址，其中，第一级联池中包括多个具有共同特征的掩码五元组； 针对所述第二片内存储区的每一个存储地址，在该存储地址对应的存储空间配置第二级联池所对应的处理动作，并以该存储地址作为第二级联池所对应的第二存储地址，其中，第二级联池中包括多个具有共同特征的掩码五元组； 以第一存储地址和第二存储地址组合后的地址作为第三片内存储区的存储地址，在该存储地址对应的存储空间配置具有级联关系的第一级联池和第二级联池所对应的处理动作。

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