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龙图腾网获悉上海集成电路装备材料产业创新中心有限公司;上海集成电路研发中心有限公司申请的专利计数电路、读出电路及图像传感器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115150573B 。

龙图腾网通过国家知识产权局官网在2026-04-10发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210752776.3，技术领域涉及：H04N25/78；该发明授权计数电路、读出电路及图像传感器是由何学红;董林妹;许开一;张远设计研发完成，并于2022-06-29向国家知识产权局提交的专利申请。

本计数电路、读出电路及图像传感器在说明书摘要公布了：本发明提供了一种计数电路，包括与非门、至少一个格雷码计数器和至少一个转换电路，所述与非门用于接收时钟信号和计数控制信号，所述格雷码计数器之间呈级联关系，下一级所述格雷码计数器的时钟端与上一级所述格雷码计数器的进位输出端连接，最上一级所述格雷码计数器的时钟端与所述与非门的输出端连接；所述转换电路与所述格雷码计数器的格雷码输出端一一对应连接，用于接收格雷码，然后将所述格雷码转换为二进制码，采用了格雷码计数器，减少了翻转次数，进而降低了功耗。本发明还提供了一种读出电路和图像传感器。

本发明授权计数电路、读出电路及图像传感器在权利要求书中公布了：1.一种计数电路，其特征在于，包括： 与非门，用于接收时钟信号和计数控制信号； 至少一个格雷码计数器，所述格雷码计数器之间呈级联关系，下一级所述格雷码计数器的时钟端与上一级所述格雷码计数器的进位输出端连接，最上一级所述格雷码计数器的时钟端与所述与非门的输出端连接；以及 至少一个转换电路，与所述格雷码计数器的格雷码输出端一一对应连接，用于接收格雷码，然后将所述格雷码转换为二进制码； 当所述格雷码计数器为2位时，所述格雷码计数器包括两个D触发器和逻辑电路，两个所述D触发器包括第一D触发器和第二D触发器，所述逻辑电路包括或非门，所述第一D触发器的时钟端和所述第二D触发器的时钟端连接，作为所述格雷码计数器的时钟端，所述第一D触发器的正相输出端与所述第二D触发器的数据输入端、所述或非门的第二输入端连接，所述第一D触发器的数据输入端与所述第二D触发器的反相输出端、所述或非门的第一输入端连接； 当所述格雷码计数器为3位时，所述格雷码计数器包括三个D触发器和逻辑电路，三个所述D触发器包括第一D触发器、第二D触发器和第三D触发器，所述逻辑电路包括或非门、第一与非门、第二与非门、第三与非门、第四与非门、第五与非门和异或非门，所述第一D触发器的时钟端、所述第二D触发器的时钟端和第三D触发器的时钟端相连接，作为所述格雷码计数器的时钟端，所述第一D触发器的数据输入端与所述异或非门的输出端、所述或非门的第一输入端连接，所述第一D触发器的正相输出端与所述第二与非门的第二输入端、所述第四与非门的第一输入端连接，所述第一D触发器的反相输出端与所述第三与非门的第一输入端连接，所述第二D触发器的数据输入端与所述第一与非门的输出端、所述或非门的第二输入端连接，所述第二D触发器的正相输出端与所述异或非门的第一输入端、所述第三与非门的第二输入端连接，所述第三D触发器的数据输入端与所述第五与非门的输出端、所述或非门的第三输入端连接，所述第三D触发器的正相输出端与所述异或非门的第二输入端和所述第四与非门的第二输入端连接，所述第三D触发器的反相输出端与所述第二与非门的第一输入端连接，所述第二与非门的输出端与所述第一与非门的第一输入端连接，所述第三与非门的输出端与所述第五与非门的第一输入端连接，所述第四与非门的输出端与所述第一与非门的第二输入端和所述第五与非门的第二输入端连接； 当所述格雷码计数器为4位时，所述格雷码计数器包括四个D触发器和逻辑电路，四个所述D触发器包括第一D触发器、第二D触发器、第三D触发器和第四D触发器，所述逻辑电路包括或非门、第一与非门、第二与非门、第三与非门、第四与非门、第五与非门、异或非门、第六与非门、第七与非门、第八与非门、第九与非门、第十与非门、第十一与非门和异或门，所述第一D触发器的时钟端、所述第二D触发器的时钟端、所述第三D触发器的时钟端和所述第四D触发器的时钟端相连接，作为所述格雷码计数器的时钟端，所述第一D触发器的数据输入端与异或门的输出端、所述或非门的第一输入端连接，所述第一D触发器的正相输出端与所述第二与非门的第一输入端、所述第五与非门的第二输入端和所述第八与非门的第二输入端连接，所述第一D触发器的反相输出端与所述第一与非门的第二输入端、所述第六与非门的第三输入端和所述第十与非门的第三输入端连接，所述第二D触发器数据输入端与所述第三与非门的输出端、所述或非门的第二输入端连接，所述第二D触发器的正相输出端与所述第一与非门的第一输入端、所述异或门的第二输入端、所述第六与非门的第二输入端、所述第九与非门的第二输入端连接，所述第二D触发器的反相输出端与所述第四与非门的第二输入端、所述第十与非门的第二输入端连接，所述第三D触发器的数据输入端与所述第七与非门的输出端、所述或非门的第三输入端连接，所述第三D触发器的正相输出端与所述异或非门的第二输入端、所述第四与非门的第一输入端、所述第五与非门的第一输入端、所述第十与非门的第一输入端连接，所述第四D触发器的数据输入端与所述第十一与非门的输出端、所述或非门的第四输入端连接，所述第四D触发器的正相输出端与所述异或非门的第一输入端、所述第八与非门的第一输入端、所述第九与非门的第一输入端连接，所述第四D触发器的反相输出端与所述第六与非门的第一输入端连接。

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