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龙图腾网获悉东南大学申请的专利具有宽锁频范围的高速延迟锁相环及其锁定方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116683908B 。

龙图腾网通过国家知识产权局官网在2026-04-03发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310296311.6，技术领域涉及：H03L7/081；该发明授权具有宽锁频范围的高速延迟锁相环及其锁定方法是由陈莹梅;范文天;陈膺昊;郭超设计研发完成，并于2023-03-24向国家知识产权局提交的专利申请。

本具有宽锁频范围的高速延迟锁相环及其锁定方法在说明书摘要公布了：本发明公开了一种具有宽锁频范围的高速延迟锁相环及其锁定方法，属于集成电路设计领域，高速延迟锁相环包括：输入缓冲级用于输入参考时钟；压控延迟链用于生成9路八相位差分时钟信号；逻辑电平转换器用于生成9路八相位单端时钟信号；错锁检测模块用于根据压控延迟链的总延迟和参考时钟周期的比较生成电压调节信号；相位检测模块用于根据电压调节信号调节压控延迟链的总延迟，在相位检测模块进入正常工作状态后，根据参考时钟和反馈时钟的相位差的比较结果调节控制电压值以调整压控延迟链的总延迟，直至参考时钟与反馈时钟的频率相同且相位同步，锁定延迟锁相环。通过内置错锁检测模块，避免了延迟锁相环在整数倍频或者分频下的错误锁定。

本发明授权具有宽锁频范围的高速延迟锁相环及其锁定方法在权利要求书中公布了：1.一种具有宽锁频范围的高速延迟锁相环，其特征在于，包括： 输入缓冲级，所述输入缓冲级的输入端口与参考时钟连接； 压控延迟链，所述压控延迟链的第一输入端口与所述输入缓冲级的输出端口连接，用于生成9路八相位差分时钟信号； 逻辑电平转换器，所述逻辑电平转换器的输入端口与所述压控延迟链的输出端口连接，用于根据所述9路八相位差分时钟信号生成9路八相位单端时钟信号； 错锁检测模块，所述错锁检测模块的输入端口与所述逻辑电平转换器的输出端口连接，用于对所述压控延迟链的总延迟和参考时钟周期进行比较，根据比较结果生成电压调节信号； 相位检测模块，所述相位检测模块的控制输入端口与所述错锁检测模块的输出端口连接，输出端口与所述压控延迟链的第二输入端口连接，用于根据所述电压调节信号调节输出至所述压控延迟链的控制电压值，以调整所述压控延迟链的总延迟，使得所述相位检测模块进入正常工作状态；所述相位检测模块的时钟输入端口分别连接所述逻辑电平转换器输出的2路同相位时钟信号，作为参考时钟和反馈时钟，在所述相位检测模块进入正常工作状态后，比较所述参考时钟和所述反馈时钟的相位差，根据比较结果调节所述控制电压值以调整所述压控延迟链的总延迟，直至所述参考时钟与所述反馈时钟的频率相同且相位同步，锁定延迟锁相环。

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