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龙图腾网获悉西安简矽技术有限公司申请的专利DFT资源配置预测方法、装置、电子设备及存储介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121503378B 。

龙图腾网通过国家知识产权局官网在2026-03-31发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202610043053.4，技术领域涉及：G06F30/333；该发明授权DFT资源配置预测方法、装置、电子设备及存储介质是由杨姣设计研发完成，并于2026-01-14向国家知识产权局提交的专利申请。

本DFT资源配置预测方法、装置、电子设备及存储介质在说明书摘要公布了：本公开提供了一种DFT资源配置预测方法、装置、电子设备及存储介质，属于电子设计自动化技术领域，该方法包括：基于目标芯片的工艺节点，确定基准器件密度；基于目标芯片的芯片规划面积和预估的非数字逻辑功能区域，确定有效数字逻辑版图面积；根据目标芯片的物理设计约束对应的利用率因子，对有效数字逻辑版图面积进行修正，得到可用的标准单元布局容量；根据标准单元布局容量及基准器件密度，通过逻辑深度映射模型，生成目标芯片的时序元件数量预测区间；根据时序元件数量预测区间，生成目标芯片的可测性设计DFT架构配置参数。能够在芯片设计早期，快速、准确地预测芯片寄存器数量及生成DFT架构配置参数。

本发明授权DFT资源配置预测方法、装置、电子设备及存储介质在权利要求书中公布了：1.一种DFT资源配置预测方法，其特征在于，所述DFT资源配置预测方法包括： 基于目标芯片的工艺节点，确定基准器件密度； 基于所述目标芯片的芯片规划面积和预估的非数字逻辑功能区域，确定有效数字逻辑版图面积； 根据所述目标芯片的物理设计约束对应的利用率因子，对所述有效数字逻辑版图面积进行修正，得到可用的标准单元布局容量； 根据所述标准单元布局容量及所述基准器件密度，通过逻辑深度映射模型，生成所述目标芯片的时序元件数量预测区间； 根据所述时序元件数量预测区间，生成目标芯片的可测性设计DFT架构配置参数； 所述逻辑深度映射模型包含第一转换系数和第二转换系数，所述第一转换系数和第二转换系数分别对应于不同的逻辑锥深度；所述根据所述标准单元布局容量及所述基准器件密度，通过逻辑深度映射模型，生成所述目标芯片的时序元件数量预测区间，包括： 利用所述第一转换系数，确定对应于高密度流水线设计场景的时序元件数量的上限值； 利用所述第二转换系数，确定对应于复杂控制逻辑设计场景的时序元件数量的下限值； 所述DFT架构配置参数包括以下至少一项：扫描链通道数量，测试压缩逻辑的压缩倍率，测试模式下的最大功耗预算；所述根据所述时序元件数量预测区间，生成目标芯片的可测性设计DFT架构配置参数，包括： 基于所述时序元件数量的上限值，确定满足预设测试时间约束所需的所述扫描链通道数量和测试压缩逻辑的压缩倍率； 基于所述时序元件数量的上限值和预设的翻转率，确定测试模式下的最大功耗预算。

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