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龙图腾网获悉深圳市菲尼瑞斯科技有限公司申请的专利基于同步触发与并行传输的高速数据通讯方法与系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN121301250B 。

龙图腾网通过国家知识产权局官网在2026-03-03发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202511870146.6，技术领域涉及：G06F13/28；该发明授权基于同步触发与并行传输的高速数据通讯方法与系统是由张易怀设计研发完成，并于2025-12-12向国家知识产权局提交的专利申请。

本基于同步触发与并行传输的高速数据通讯方法与系统在说明书摘要公布了：本发明涉及嵌入式系统技术领域，提供一种基于同步触发与并行传输的高速数据通讯方法与系统。该方法包括：在MCU中配置一个主定时器、多个从定时器及对应数量的DMA通道，并设置各DMA通道对应的数据缓冲区；配置主定时器产生目标采样率的同步触发信号，驱动所有从定时器生成同步且相位依次延迟的更新事件作为并行DMA触发信号；利用这些信号控制各DMA通道将外部设备数据并行交替传输至缓冲区对应区域；最后根据更新事件的相位顺序对多区域数据进行时序重组，还原完整采样序列。本发明突破单DMA通道的速率瓶颈，利用多DMA通道的聚合带宽，在有限硬件资源下实现远超单DMA极限的高采样率数据采集，有效提升系统数据吞吐率。

本发明授权基于同步触发与并行传输的高速数据通讯方法与系统在权利要求书中公布了：1.一种基于同步触发与并行传输的高速数据通讯方法，其特征在于，包括： 在微控制器单元MCU中配置一个主定时器、多个从定时器以及与所述从定时器数量对应的多个直接内存访问DMA通道，并在MCU内存中设置各DMA通道对应的数据缓冲区，每个数据缓冲区对应一个独立的存储区域，每一所述存储区域对应一个DMA通道的目的地址； 配置所述主定时器产生目标采样率的同步触发信号，并配置所有从定时器基于所述同步触发信号产生多个同步且相位依次延迟的更新事件，以作为多个并行的DMA触发信号；利用所述DMA触发信号，控制对应的DMA通道将来自外部设备的数据并行且交替地传输至所述数据缓冲区的各自对应存储区域； 基于所述从定时器更新事件的相位延迟顺序，对存储在多个所述存储区域中的数据进行时序重组，以还原出由所述目标采样率定义的完整采样序列; 配置所有从定时器产生所述更新事件时，包括：将全部从定时器配置为以所述主定时器的同步触发信号为时钟源，并为每个从定时器设置相同的自动重载值与不同的计数器初始值，以使所有从定时器产生同步且相位依次延迟的更新事件; 所述从定时器的数量为N个，其中N为大于1的整数；所述目标采样率为Fs，每个从定时器所产生的更新事件的频率为FsN；通过配置N个从定时器产生相位依次延迟的更新事件，使得N个对应的DMA通道以FsN的操作频率并行工作，以实现N倍于单个DMA通道操作频率的数据吞吐率。

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