中国人民解放军军事科学院国防科技创新研究院蒋艳德获国家专利权
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龙图腾网获悉中国人民解放军军事科学院国防科技创新研究院申请的专利面向SoC芯片验证的DDR模型系统及其使用方法获国家发明授权专利权,本发明授权专利权由国家知识产权局授予,授权公告号为:CN120994589B 。
龙图腾网通过国家知识产权局官网在2026-03-03发布的发明授权授权公告中获悉:该发明授权的专利申请号/专利号为:202511512492.7,技术领域涉及:G06F13/16;该发明授权面向SoC芯片验证的DDR模型系统及其使用方法是由蒋艳德;赵夏;张光达;王会权;裴秉玺;方健;张瑞康;马敬博设计研发完成,并于2025-10-22向国家知识产权局提交的专利申请。
本面向SoC芯片验证的DDR模型系统及其使用方法在说明书摘要公布了:本发明公开了一种面向SoC芯片验证的DDR模型系统及其使用方法,涉及芯片设计验证技术领域,该系统包括:多个协议接口模块,能够连接SoC芯片上被验证的电路模块,用于接收不同总线接口协议的命令序列;初始化数据模块,用于存储DDR控制器初始化所需的关键时序信息,将不同总线接口协议的命令序列转换为符合JEDECDDR规范的命令序列,支持通过后门方式直接加载关键时序信息,在复位后能够自动加载关键时序信息到寄存器;地址映射模块,用于将命令序列中的逻辑地址映射为存储模块所能识别的物理地址,并将逻辑地址对应的数据写入存储模块的相应位置。本发明能够大幅缩短DDR控制器初始化时间,加速SoC芯片的模拟验证过程。
本发明授权面向SoC芯片验证的DDR模型系统及其使用方法在权利要求书中公布了:1.一种面向SoC芯片验证的DDR模型系统,其特征在于,所述DDR模型系统用于在仿真验证环境中替代真实的DDR控制器、DDR物理接口和SDRAM模块,以跳过真实的DDR控制器初始化过程,包括: 多个协议接口模块,能够连接SoC芯片上被验证的电路模块,用于接收不同总线接口协议的命令序列,一个所述协议接口模块对应一个类型的总线接口协议,每个所述协议接口模块负责接收其对应的总线接口协议的命令序列; 初始化数据模块,分别与多个所述协议接口模块连接,且配置有寄存器和后门操作接口,用于存储DDR控制器初始化所需的关键时序信息,将不同总线接口协议的命令序列转换为符合JEDECDDR规范的命令序列,支持通过后门方式直接加载DDR控制器初始化所需的关键时序信息,在复位后能够自动加载关键时序信息到寄存器; 地址映射模块,分别与所述初始化数据模块和存储模块连接,用于将命令序列中的逻辑地址映射为所述存储模块所能识别的物理地址,并将逻辑地址对应的数据写入所述存储模块的相应位置; 所述存储模块,用于进行数据的存储; 所述DDR模型系统通过一个多比特位宽的模式选择参数和编译宏定义进行配置,以选择启用不同的协议接口模块; 其中,所述模式选择参数的最高位用于选择使用DDR模型系统或真实的DDR控制器,所述模式选择参数的低位用于在选择DDR模型系统时进一步选择启用的协议接口模块; 所述DDR模型系统通过一个多比特位宽的模式选择参数和编译宏定义进行配置,以选择启用不同的协议接口模块,包括: 判断ddr_model[3]的值; 若ddr_model[3]的值为1’b0,则选择DDR模型系统的工作模式为不启用,并使用真实的DDR控制器的宏定义,以使用真实的DDR控制器进行SoC芯片中电路模块的功能验证,正常对DDR控制器进行初始化; 若ddr_model[3]的值为1’b1,则选择DDR模型系统的工作模式为启用,并进一步判断ddr_model[2]的值; 若ddr_model[2]的值为1’b0,则使用APB协议接口模块的宏定义,以使DDR模型系统通过APB协议接口模块连接SoC芯片中被验证的电路模块; 若ddr_model[2]的值为1’b1,则使用AHB协议接口模块的宏定义,以使DDR模型系统通过AHB协议接口模块连接SoC芯片中被验证的电路模块; 其中,ddr_model[3]表示模式选择参数的第3位;ddr_model[2]表示模式选择参数的第2位;1’b0表示一个1比特宽的二进制数,值为0;1’b1表示一个1比特宽的二进制数,值为1。
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