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龙图腾网获悉广东芯培森技术有限公司申请的专利一种适用于高性能原子级计算芯片的物理设计方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120654619B 。

龙图腾网通过国家知识产权局官网在2026-03-03发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510777193.X，技术领域涉及：G06F30/327；该发明授权一种适用于高性能原子级计算芯片的物理设计方法是由刘杰;陶佑源;赵卓影;于志强;樊正伟设计研发完成，并于2025-06-11向国家知识产权局提交的专利申请。

本一种适用于高性能原子级计算芯片的物理设计方法在说明书摘要公布了：本发明涉及集成电路设计领域，公开了一种适用于高性能原子级计算芯片的物理设计方法。本发明首先对RTL代码进行分析，进行模块分割并生成所需的存储器；接着进行逻辑综合，针对存储器至寄存器路径设立不同路径组并赋予不同权重；在布局布线阶段，依据各模块算法功能及数据流走向，实现顶层布局规划、模块布局规划、电源地规划、布局、时钟树综合、布线及设计规则检查；然后进行物理验证、时序分析、功耗与电压降分析，并通过充分的迭代优化，确保最终设计满足时序、功耗及电压降要求。本发明聚焦于高性能原子级计算芯片物理设计，有效应对计算密集、设计复杂度高、芯片规模大、功耗高等挑战，在保证高性能的基础上，提升了芯片的可靠性。

本发明授权一种适用于高性能原子级计算芯片的物理设计方法在权利要求书中公布了：1.一种适用于高性能原子级计算芯片的物理设计方法，其特征在于，包括以下步骤： S1，确定原子级计算芯片层次化设计中各子模块的分割方案，统计各模块端口及其数据交互关系，整理形成模块交互关系图，并根据存储需求确定各子模块所需存储器的类型、位宽和深度；同时，根据存储数据的种类和存储器的读写周期，对存储器进行分类； S2，逻辑综合，依据步骤S1中获取的存储器读写周期大小，为各存储器到寄存器设立不同的路径组并赋予不同权重，随后采用DesignCompiler综合工具进行逻辑综合，使工具对各路径组进行不同程度的优化； S3，布局布线，采用INNOVUS自动布局布线工具，结合步骤S1得到的模块端口与数据交互情况以及步骤S2得到的网表，完成顶层布局规划、模块布局规划、电源地规划、布局、时钟树综合、布线、设计规则检查designrulecheck,DRC； S4，物理验证，采用Calibre工具，对原子级计算芯片的各模块以及顶层进行DRC、LVS、ANT、ERC检查； S5，时序分析，采用Primetime时序分析工具，在多个不同工艺角下进行建立时间与保持时间的时序检查，确保多个工艺角的时序结果同时满足要求； S6，功耗与电压降分析，采用Redhawk工具对功耗组成进行分析，明确降低功耗的切入点并进行针对性优化，同时检查电压降是否处于合理范围，对电压降严重区域进行针对性优化。

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