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龙图腾网获悉珠海横琴芯存半导体有限公司申请的专利延迟锁相环系统及存储器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN120200604B 。

龙图腾网通过国家知识产权局官网在2026-02-27发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202311714577.4，技术领域涉及：H03L7/089；该发明授权延迟锁相环系统及存储器是由方海彬;王梦海;黄碧云设计研发完成，并于2023-12-13向国家知识产权局提交的专利申请。

本延迟锁相环系统及存储器在说明书摘要公布了：本发明提供一种延迟锁相环系统及存储器，其在原有的延迟锁相环系统的电路结构上，添加时钟丢失检测电路来检测DLL环路的时钟反馈节点处是否存在丢时钟的情况，方案简单，易于实现，且当时钟丢失检测电路检测到丢时钟的情况时，使DLL环路冻结当前的延迟线长度即暂时不调整延迟线长度，并使DCC环路将DLL环路的输出时钟信号的占空比调节至设定值，直到时钟丢失检测电路检测到没有丢时钟的情况后，才使DLL环路恢复工作，解除对延迟线长度的冻结即解冻延迟线长度，从而继续调整延迟线长度，以完成DLL环路锁定，由此在存储器的工作条件很差时，也能保证DLL环路可以顺利完成锁定。

本发明授权延迟锁相环系统及存储器在权利要求书中公布了：1.一种延迟锁相环系统，其特征在于，包括： DLL环路，用于将其接收的输入时钟信号与其输出的输出时钟信号进行相位对齐，所述DLL环路包括DLL控制器，所述DLL控制器用于根据所述输入时钟信号的周期产生相应的状态信号； DCC环路，耦接所述DLL环路，并用于调整所述输出时钟信号的占空比； 时钟丢失检测电路，耦接所述DLL环路的时钟反馈节点，且包括： 复位信号产生电路，耦接所述DLL控制器，并用于根据所述状态信号产生相应的复位信号； 时钟边沿检测电路，耦接所述复位信号产生电路的输出端和所述时钟反馈节点，且用于根据所述复位信号复位，以及，在复位结束后至所述状态信号下一次有效前的期间内，检测所述时钟反馈节点输出的反馈时钟信号的上升沿或下降沿的个数，并根据检测结果输出相应的指示信号，其中，所述指示信号有效时，表示所述时钟反馈节点没有丢失时钟的情况； 解冻信号产生电路，耦接所述DLL控制器和所述时钟边沿检测电路，并用于在DLL环路锁定过程中，在所述指示信号表示所述时钟反馈节点存在丢时钟的情况时，使所述DLL环路冻结其当前的延迟线长度，同时使所述DCC环路将所述输出时钟信号的占空比调至设定值，以及，在所述指示信号和所述状态信号均有效时，产生有效的解冻信号至所述DLL控制器，使所述DLL环路解除对其延迟线长度的冻结，以调整延迟线长度使所述DLL环路完成锁定。

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