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龙图腾网获悉哈尔滨工业大学申请的专利用于时间数字转换器的抽头延时线及其编码系统获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116974176B 。

龙图腾网通过国家知识产权局官网在2026-02-27发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310962686.1，技术领域涉及：G04F10/00；该发明授权用于时间数字转换器的抽头延时线及其编码系统是由朱敏;祁夕涵;尹佳恒;高强;卢礼华;崔唐设计研发完成，并于2023-08-01向国家知识产权局提交的专利申请。

本用于时间数字转换器的抽头延时线及其编码系统在说明书摘要公布了：一种用于时间数字转换器的抽头延时线及其编码系统，属于时间数字转换器技术领域。本发明为解决现有抽头延迟线的时间测量精度低的问题。包括M+1个可编程逻辑块CLB0至CLBM；每个CLB基于进位链carry8实现，包括8个加法器；每个加法器具有di输入端和s输入端，每个加法器的o抽头和co抽头对应连接到两个D触发器，通过D触发器输出采样信号；对加法器的输入信号进行初始化，在触发信号为0时，基于采样信号获得CLB0至CLBM输出的原始联合波形；在触发阶段，在最邻近的系统时钟上升沿时刻得到的信号传播波形确定触发信号至系统时钟上升沿时刻之间的时长，作为延时时间。本发明用于延时时间的测量。

本发明授权用于时间数字转换器的抽头延时线及其编码系统在权利要求书中公布了：1.一种用于时间数字转换器的抽头延时线及其编码系统，其特征在于包括M+1个可编程逻辑块CLB0至CLBM，M为正整数； 每个CLB基于进位链carry8实现，包括8个加法器；每个加法器具有di输入端和s输入端，每个加法器的o抽头和co抽头对应连接到两个D触发器，通过D触发器输出采样信号； M+1个可编程逻辑块顺次级联，相邻前一个CLB的co7抽头连接相邻后一个CLB的cin脚； 其中CLB0的第一个加法器的输入端di0输入触发信号Tri，输入端s0初始化为信号1；第二个加法器的输入端di1至第七个加法器的输入端di7均初始化为信号0，对应的输入端s1至s7均初始化为信号1； CLB1至CLB3的初始化信号相同，每一个加法器的输入端di均初始化为信号0，每一个加法器的输入端s均初始化为信号1； CLB4的第一个加法器的输入端di0初始化为Tri_n，Tri_n与Tri反向，输入端s0初始化为信号1；第二个加法器的输入端di1至第七个加法器的输入端di7均初始化为信号0，对应的输入端s1至s7均初始化为信号1； CLB5的8个加法器的输入端的初始化信号相同，每一个加法器的输入端di均初始化为信号0，每一个加法器的输入端s均初始化为信号1； CLB6的第一个加法器的输入端di0输入触发信号Tri，输入端s0初始化为信号1；第二个加法器的输入端di1至第七个加法器的输入端di7均初始化为信号0，对应的输入端s1至s7均初始化为信号1； CLB7至CLBM的初始化信号相同，每一个加法器的输入端di均初始化为信号0，每一个加法器的输入端s均初始化为信号1； 在初始阶段下，触发信号Tri＝0，Tri_n＝1，基于采样信号获得CLB0至CLBM输出的原始联合波形； 在触发阶段，当触发信号Tri＝1后，在最邻近的系统时钟上升沿时刻采样获得CLB0至CLBM输出的信号传播波形；根据所述信号传播波形确定触发信号Tri＝1时刻至所述系统时钟上升沿时刻之间的时长，作为触发信号Tri传播对应的延时时间； 确定触发信号Tri传播对应的延时时间的具体方法为： 在触发阶段，Tri＝1时，Tri_n＝0，在距离信号触发点最邻近的系统时钟上升沿时刻，基于采样信号获得CLB0至CLBM输出的信号传播波形，将信号传播波形中信号1的个数与原始联合波形中信号1的个数进行比较，将每个加法器作为一个延时单元，确定触发信号由起始时刻至系统时钟上升沿时刻所经过的延时单元的个数，根据每个延时单元的延时时间确定触发信号Tri传播对应的延时时间。

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