深圳鸿芯微纳技术有限公司;上海鸿芯科纳科技有限公司刘丽红获国家专利权
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龙图腾网获悉深圳鸿芯微纳技术有限公司;上海鸿芯科纳科技有限公司申请的专利一种时钟树的时序优化方法、计算机可读存储介质获国家发明授权专利权,本发明授权专利权由国家知识产权局授予,授权公告号为:CN121257463B 。
龙图腾网通过国家知识产权局官网在2026-02-10发布的发明授权授权公告中获悉:该发明授权的专利申请号/专利号为:202511826484.X,技术领域涉及:G06F30/396;该发明授权一种时钟树的时序优化方法、计算机可读存储介质是由刘丽红;林明豪;王磊设计研发完成,并于2025-12-05向国家知识产权局提交的专利申请。
本一种时钟树的时序优化方法、计算机可读存储介质在说明书摘要公布了:一种时钟树的时序优化方法、计算机可读存储介质,涉及时钟树综合和时序优化技术领域。该方法包括:获取待处理时序路径,从待处理时序路径开始,对待处理时序路径进行时序优化,时序优化包括:确定时序裕量最小的寄存器为待处理寄存器;根据待处理寄存器的多个扇入端时序裕量确定目标扇入端时序裕量;和或,根据待处理寄存器的多个扇出端时序裕量确定目标扇出端时序裕量;根据目标扇入端时序裕量和或目标扇出端时序裕量计算时钟偏移量;根据时钟偏移量调整待处理寄存器的各个扇入端时序裕量和或待处理寄存器的各个扇出端时序裕量;对待处理时序路径进行更新,直至达到设定结束条件。
本发明授权一种时钟树的时序优化方法、计算机可读存储介质在权利要求书中公布了:1.一种时钟树的时序优化方法,其特征在于,包括: 获取所述时钟树上所有时序路径的时序裕量,确定所有时序路径中时序裕量最小的一条时序路径为待处理时序路径,所述待处理时序路径包括起始端寄存器和终止端寄存器; 从所述待处理时序路径开始,对所述待处理时序路径进行时序优化,所述时序优化包括: 对所述待处理时序路径中的起始端寄存器的时序裕量和所述待处理时序路径中的终止端寄存器的时序裕量进行比较,以确定时序裕量最小的寄存器为待处理寄存器; 获取所述待处理寄存器的多个扇入端时序裕量,根据所述待处理寄存器的多个扇入端时序裕量确定目标扇入端时序裕量; 获取所述待处理寄存器的多个扇出端时序裕量,根据所述待处理寄存器的多个扇出端时序裕量确定目标扇出端时序裕量; 根据所述目标扇入端时序裕量和或所述目标扇出端时序裕量计算时钟偏移量; 根据所述时钟偏移量调整所述待处理寄存器的各个扇入端时序裕量和或所述待处理寄存器的各个扇出端时序裕量,以完成所述待处理时序路径的时序优化; 重新获取所述时钟树上所有时序路径的时序裕量,并将所有时序路径中时序裕量最小的一条时序路径更新为所述待处理时序路径,以进行所述时序优化,直至达到设定结束条件。
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