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龙图腾网获悉中国科学技术大学申请的专利一种粗粒度可重构阵列及其硬件建模生成方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119940250B 。

龙图腾网通过国家知识产权局官网在2026-01-23发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510016687.6，技术领域涉及：G06F30/34；该发明授权一种粗粒度可重构阵列及其硬件建模生成方法是由徐奇;庞红玉;陈松设计研发完成，并于2025-01-06向国家知识产权局提交的专利申请。

本一种粗粒度可重构阵列及其硬件建模生成方法在说明书摘要公布了：本发明公开了一种粗粒度可重构阵列及其硬件建模生成方法，属于数字电路设计和处理技术领域。粗粒度可重构阵列，包括：由M行N列处理单元形成的可重构阵列的处理单元阵列，用于暂存处理单元操作配置信息的配置存储器，用于连接配置存储器与处理单元的配置总线和输入输出接口。建模生成方法包括由输入的顶层硬件设计参数自顶向底逐层次生成子模块设计参数和自底向顶实例化硬件生成器生成硬件RTL级代码。采用本发明所述的粗粒度可重构阵列及其硬件建模生成方法，能够完成粗粒度可重构阵列的敏捷建模和RTL级代码生成；通过设计硬件描述中间表示，实现驱动编译工具的目标重定向；并极大地提高硬件加速器在硬件设计和软件堆栈开发的效率。

本发明授权一种粗粒度可重构阵列及其硬件建模生成方法在权利要求书中公布了：1.一种粗粒度可重构阵列，其特征在于，包括： 处理单元阵列，为由M行N列处理单元形成的可重构阵列，M为大于等于1的整数，N为大于等于1的整数，处理单元根据输入的操作配置信息和输入数据，执行计算或存取操作，并将计算或存取结果输出； 配置存储器，用于暂存处理单元阵列中各节点执行时所需的操作配置信息； 配置总线，用于连接配置存储器与处理单元，至少向一个处理单元输入操作配置信息； 输入输出接口，将处理单元与外部设备连接，用于向处理单元输入数据或输出处理单元的计算结果； 处理单元阵列由计算单元和存取单元两类处理单元组成； 所述处理单元为存取单元或计算单元； 存取单元用于存储和读取数据，在所述粗粒度可重构阵列工作时，在计算单元计算开始前存储输入数据，在计算单元计算时暂存中间数据和计算单元计算完成后存储输出数据； 计算单元用于根据输入的操作配置信息和输入数据，执行计算操作，并输出执行结果； 所述存取单元包括： 存储配置寄存器，用于暂存由配置总线输入的存储操作配置信息； 便笺存储器，由SRAM构成，用于缓存数据； 存储多路选通器，与相邻的计算单元连接，根据存储寄存器中的存储操作配置信息选中相应的输入数据； 逻辑单元，用于执行存取单元的逻辑；根据存储操作配置信息，当工作在加载状态时，从便笺存储器取出数据并输出；当工作在存储状态时，向便笺存储器存放输入数据，并直接输出输入数据； 所述计算单元包括： 计算配置寄存器，用于暂存配置总线输入的计算操作配置信息； 计算多路选通器，与相邻的计算单元连接，根据计算寄存器中的计算操作配置信息选中相应的输入数据； 同步器，对经过多路选通器选通的输入数据进行延时，使输入数据同步，根据计算操作配置信息中的延时选通信息选通相应数据输入到算术运算单元； 算术运算单元，根据计算操作配置信息中的计算操作码执行算术运算，得到结果数据；或直接输出输入数据； 所述计算单元中只在一侧的计算多路选通器后设置有同步器，在另一侧计算多路选通器的输入数据达到后的下一时钟到达时立即执行运算； 粗粒度可重构阵列的硬件建模生成方法，其特征在于，包括以下步骤： S1、建模，将粗粒度可重构阵列的硬件结构分为顶层设计原语、中间层设计原语和底层设计原语，顶层设计原语为粗粒度可重构阵列，中间层设计原语包括配置存储器、总线、计算单元和存取单元，底层设计原语包括计算配置寄存器、计算多路选通器、同步器、算术运算单元和存储配置寄存器、存储多路选通器、便笺存储器；根据输入的顶层硬件设计参数从顶向底地依次进行顶层设计原语、中间层设计原语和底层设计原语的硬件的建模并生成顶层设计原语、中间层设计原语、底层设计原语的子模块硬件设计参数；输出硬件描述中间表示，用于驱动编译工具的目标重定向； S2、生成，建模完成后，根据顶层硬件设计参数、中间层硬件设计参数和底层硬件设计参数从底层向顶层对硬件生成器进行实例化，输出硬件RTL级代码。

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