北京航空航天大学陈挺然获国家专利权
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龙图腾网获悉北京航空航天大学申请的专利一种扩展单元获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116050492B 。
龙图腾网通过国家知识产权局官网在2026-01-23发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310125095.9，技术领域涉及：G06N3/063；该发明授权一种扩展单元是由陈挺然;潘彪;康旺设计研发完成，并于2023-02-06向国家知识产权局提交的专利申请。
本一种扩展单元在说明书摘要公布了：本发明提供一种扩展单元，涉及存内计算技术领域。所述扩展单元包括输入输出模块、输入FIFO、输出FIFO、模拟存算一体阵列、近存电路和状态机；其中：所述输入输出模块用于实现所述扩展单元与外部信号交互；所述输入FIFO用于缓冲输入数据，并在缓冲输入数据过程中将CPU时钟域转化为计算时钟域；所述输出FIFO用于缓冲输出数据，并在缓冲输出数据过程中将计算时钟域转化为CPU时钟域；所述模拟存算一体阵列用于实现乘累加运算；所述近存电路用于处理乘累加运算结果；所述状态机用于运行所述模拟存算一体阵列。本发明实施例提供的扩展单元，能够提高计算资源利用率。
本发明授权一种扩展单元在权利要求书中公布了：1.一种扩展单元，其特征在于，包括： 输入输出模块、输入FIFO、输出FIFO、模拟存算一体阵列、近存电路和状态机；其中： 所述输入输出模块用于实现所述扩展单元与外部信号交互，与所述输入FIFO、所述输出FIFO、所述模拟存算一体阵列和所述近存电路分别相连接； 所述输入FIFO用于缓冲输入数据，并在缓冲输入数据过程中将CPU时钟域转化为计算时钟域，与所述模拟存算一体阵列、所述近存电路和所述状态机分别相连接； 所述输出FIFO用于缓冲输出数据，并在缓冲输出数据过程中将计算时钟域转化为CPU时钟域，与所述近存电路相连接； 所述模拟存算一体阵列用于实现乘累加运算，与所述近存电路和所述状态机分别相连接； 所述近存电路用于处理乘累加运算结果，与所述状态机相连接； 所述状态机用于运行所述模拟存算一体阵列。
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2、报告中的分析和结论仅反映本公司于发布本报告当日的职业理解，仅供参考使用，不能作为本公司承担任何法律责任的依据或者凭证。
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