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龙图腾网获悉爱芯元智半导体(上海)有限公司申请的专利卷积加速器、卷积处理方法、芯片及电子设备获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116306814B 。

龙图腾网通过国家知识产权局官网在2026-01-13发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310215606.6，技术领域涉及：G06N3/0464；该发明授权卷积加速器、卷积处理方法、芯片及电子设备是由靳馥华;孙猛;梁喆;马振强;胡文静设计研发完成，并于2023-03-07向国家知识产权局提交的专利申请。

本卷积加速器、卷积处理方法、芯片及电子设备在说明书摘要公布了：本公开提出一种卷积加速器、卷积处理方法、芯片及电子设备，其中并行度为M的卷积加速器包括：P个卷积核运算模块；M个锁存器组，每个锁存器组包括N个锁存器，每个锁存器包括多个锁存单元；P个读地址译码电路组，每个读地址译码电路组对应一个卷积核运算模块；各锁存单元用于存储权重数据；P个读地址译码电路组分别用于从各锁存单元中获取权重数据，并将权重数据发送至对应的卷积核运算模块；P个卷积核运算模块分别用于获取图数据，并对图数据和对应的读地址译码电路组发送的权重数据进行运算。采用锁存器存储权重数据，降低了后端的布局布线的难度，且读锁存器的功耗远低于读SRAM的功耗，从而降低了卷积处理过程的功耗。

本发明授权卷积加速器、卷积处理方法、芯片及电子设备在权利要求书中公布了：1.一种卷积加速器，其特征在于，所述卷积加速器的并行度为M，所述卷积加速器包括：P个卷积核运算模块；M个锁存器组，每个所述锁存器组包括N个锁存器，每个所述锁存器包括多个锁存单元；P个读地址译码电路组，每个所述读地址译码电路组对应一个所述卷积核运算模块；M、N、P分别为大于或等于1的整数；其中： 各所述锁存单元用于存储权重数据； P个所述读地址译码电路组分别用于从各所述锁存单元中获取所述权重数据，并将所述权重数据发送至对应的所述卷积核运算模块； P个所述卷积核运算模块分别用于获取图数据，并对所述图数据和对应的所述读地址译码电路组发送的所述权重数据进行运算；其中，每个所述卷积核运算模块包括读地址寄存器和读数据寄存器； 所述读地址寄存器，用于向对应的所述读地址译码电路组包括的读地址译码电路发送读地址； 各所述读地址译码电路，具体用于对所述读地址进行译码，得到译码结果，并根据所述译码结果从对应的各所述锁存单元中确定目标锁存单元，并读取所述目标锁存单元中的权重数据，以及将所述权重数据发送至对应的所述读数据寄存器； 所述读数据寄存器，用于存储对应的所述读地址译码电路发送的权重数据。

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