昕原半导体(上海)有限公司周煜梁获国家专利权
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龙图腾网获悉昕原半导体(上海)有限公司申请的专利卷积运算电路及运算方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116150557B 。
龙图腾网通过国家知识产权局官网在2026-01-13发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210242362.6，技术领域涉及：G06F17/15；该发明授权卷积运算电路及运算方法是由周煜梁设计研发完成，并于2022-03-11向国家知识产权局提交的专利申请。
本卷积运算电路及运算方法在说明书摘要公布了：本发明提供一种卷积运算电路及其运算方法，其中的卷积运算电路包括：控制逻辑、与控制逻辑连接的数据缓存模块和乘加器；其中，乘加器包括至少两个相互并联的运算模块，每个运算模块均包括一个信号输入端、至少两个相互并联的忆阻器，以及一个信号输出端；乘加器，用于对通过信号输入端进入运算模块的待处理数据进行卷积运算处理，以获取对应的运算结果；控制逻辑用于将信号输出端输出的运算结果读取至数据缓存模块中进行数据存储。利用上述发明能够灵活的实现多卷积权重的设置。
本发明授权卷积运算电路及运算方法在权利要求书中公布了：1.一种卷积运算电路，其特征在于，包括：控制逻辑、与所述控制逻辑连接的数据缓存模块和乘加器；其中， 所述乘加器包括至少两个相互并联的运算模块，每个所述运算模块均包括一个信号输入端、至少两个相互并联的忆阻器，以及一个信号输出端； 所述乘加器，用于对通过所述信号输入端进入所述运算模块的待处理数据进行卷积运算处理，以获取对应的运算结果； 所述控制逻辑用于将所述信号输出端输出的运算结果读取至所述数据缓存模块中进行数据存储； 所述至少两个相互并联的忆阻器用于对卷积权重进行设置，所述忆阻器的并联数量与所述卷积权重的bit数量相对应，以通过所述忆阻器的并联数量及阻值，调节所述卷积权重； 位于同一运算模块中的所有忆阻器并联后的电阻表示为： 其中，R0~Rn-1表示并联的忆阻器的电阻值，n表示电阻值的数量； 还包括与所述忆阻器连接的选通器件，所述选通器件用于控制所述忆阻器的工作模式，所述工作模式包括卷积权重配置、卷积运算、卷积权重存储。
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2、报告中的分析和结论仅反映本公司于发布本报告当日的职业理解，仅供参考使用，不能作为本公司承担任何法律责任的依据或者凭证。
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