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龙图腾网获悉东芯半导体股份有限公司申请的专利写操作时序逻辑电路及存储器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119864058B 。

龙图腾网通过国家知识产权局官网在2025-12-30发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411937502.7，技术领域涉及：G11C7/10；该发明授权写操作时序逻辑电路及存储器是由宋东蔚设计研发完成，并于2024-12-26向国家知识产权局提交的专利申请。

本写操作时序逻辑电路及存储器在说明书摘要公布了：本发明提供一种写操作时序逻辑电路，通过根据写操作指令、系统时钟和数据采样脉冲，鉴别出数据采样脉冲的最后一个有效的下降沿，并且在该下降沿采样完数据后控制电路自锁以将来自并行数据生成模块的多位并行的数据锁存住，直到下一次写操作指令到来才会释放，从而可以完全规避写入后采样信号WritePostamble持续的时间twpst过小导致的数据丢失风险。

本发明授权写操作时序逻辑电路及存储器在权利要求书中公布了：1.一种写操作时序逻辑电路，其特征在于，包括： 并行数据生成模块，该并行数据生成模块根据输入的串行数据和数据采样脉冲，生成多位并行的数据； 数据锁存模块，该数据锁存模块与所述并行数据生成模块连接，根据写操作指令、系统时钟和所述数据采样脉冲，将来自所述并行数据生成模块的所述多位并行的数据锁存住，且生成系统时钟域同步信号；以及 系统时钟同步模块，该系统时钟同步模块与所述数据锁存模块连接，根据所述锁存住的多位并行的数据以及所述系统时钟域同步信号，将所述锁存住的多位并行的数据同步到系统时钟域， 所述数据锁存模块包括第一触发单元、第一触发器、多位锁存器、第一反相单元、第二反相单元、第三反相单元、与门单元、以及第一反相器， 所述第一触发单元与所述第一反相单元的一端、所述第二反相单元的一端以及所述第三反相单元的一端连接，向所述第一触发单元输入所述写操作指令和所述系统时钟， 所述第一触发器的数据输入端与所述第一反相单元的另一端连接，所述第一触发器的复位端与所述与门单元连接，所述第一触发器的数据输出端与第一反相器的一端连接，向所述第一触发器的时钟输入端输入数据采样脉冲， 所述多位锁存器的时钟输入端与所述第一反相器的另一端以及所述与门单元连接，所述多位锁存器的数据输出端与所述系统时钟同步模块的数据输入端连接，向所述多位锁存器的数据输入端输入所述多位并行的数据， 所述第二反相单元的另一端与所述与门单元连接， 所述第三反相单元的另一端与所述系统时钟同步模块的时钟输入端连接。

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