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龙图腾网获悉无锡众星微系统技术有限公司申请的专利一种基于FEC的自适应的SerDes架构及其功耗调节方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119356511B 。

龙图腾网通过国家知识产权局官网在2025-12-30发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411376819.8，技术领域涉及：G06F1/3234；该发明授权一种基于FEC的自适应的SerDes架构及其功耗调节方法是由刘志惠;乔熠晖;刘冰洋;刘少华;刘磊;操礼程设计研发完成，并于2024-09-29向国家知识产权局提交的专利申请。

本一种基于FEC的自适应的SerDes架构及其功耗调节方法在说明书摘要公布了：本申请提供了一种基于FEC的自适应的SerDes架构及功耗调节方法，包括模拟前端、模数转换器、数字信号处理器、发送侧前向纠错编码器、接收侧前向纠错解码器、微程序控制器等，其中发送侧前向纠错编码器对传输数据添加额外的错误校正码对数据进行编码；接收侧前向纠错解码器对传输数据进行解码，通过添加的所述错误校正码来识别并修正在数据传输过程中出现的错误；微程序控制器用于对发送侧前向纠错编码器和接收侧前向纠错解码器进行实时监控，并且回读发送侧前向纠错编码器和接收侧前向纠错解码器的日志信息。本申请技术方案能够自适应平衡SerDes的信号质量和功耗，在不同产品场景和芯片不同PVT状态情况下均具有很好的适用性。

本发明授权一种基于FEC的自适应的SerDes架构及其功耗调节方法在权利要求书中公布了：1.一种基于FEC的自适应的SerDes架构，其特征在于，包括模拟前端、模数转换器、数字信号处理器、发送侧前向纠错编码器、接收侧前向纠错解码器、微程序控制器、锁相环、数模转换器和前馈均衡器，其中， 所述模拟前端用于对输入信号进行初步码间干扰补偿； 所述模数转换器用于将所述模拟前端初步码间干扰补偿后的信号转换成数字信号； 所述数字信号处理器用于对所述模数转换器数字化后的数字信号进行进一步码间干扰补偿，然后把输入信号中的数据恢复出来； 所述发送侧前向纠错编码器对传输数据添加额外的错误校正码对数据进行编码； 所述接收侧前向纠错解码器对所述传输数据进行解码，通过添加的所述错误校正码来识别并修正在数据传输过程中出现的错误； 所述微程序控制器用于对所述发送侧前向纠错编码器和所述接收侧前向纠错解码器进行实时监控，并且回读所述发送侧前向纠错编码器和所述接收侧前向纠错解码器的日志信息； 所述锁相环用于产生一个高速高性能的本地时钟； 所述数模转换器用于本端高速信号的发送； 所述前馈均衡器用于对本端发送的高速信号进行信号质量的预补偿， 所述微程序控制器根据数据信号的Margin状态，动态调节模拟前端和锁相环的Bias电流档位、Clock路径的Vreg电压档位、模数转换器的bit位宽档位和数字信号处理器的计算精度档位实现功耗控制。

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