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龙图腾网获悉上海交通大学;国网安徽省电力有限公司申请的专利低延时的非极大值抑制高效数字电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116468989B 。

龙图腾网通过国家知识产权局官网在2025-12-30发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310448639.5，技术领域涉及：G06V10/94；该发明授权低延时的非极大值抑制高效数字电路是由陈昱舟;张津铭;贺光辉;毛荀;夏俊丽;王桢;吕凯设计研发完成，并于2023-04-24向国家知识产权局提交的专利申请。

本低延时的非极大值抑制高效数字电路在说明书摘要公布了：本发明公开了一种低延时的非极大值抑制高效数字电路，包括：多个并联的预处理模块，仲裁模块，预处理结果缓冲模块，多个串联的NMS单元。该电路是处理流程中不需要排序所有初始候选框，降低启动延时，并行化中间缓存框排序的排序过程与缓存框的抑制过程，使得实现该算法的硬件可无阻塞的接受新的输入候选框，进一步降低处理延时，进而降低目标识别神经网络的整体延时。本发明能够在保证算法精度几乎不变的条件下，减少非极大值抑制数字电路所需占用的资源和面积，显著降低非极大值抑制算法的处理延时。

本发明授权低延时的非极大值抑制高效数字电路在权利要求书中公布了：1.一种低延时的非极大值抑制高效数字电路，其特征在于，包括： 多个并联的预处理模块，用于利用目标识别神经网络产生的候选框在置信度上的稀疏性，以较高的并行度预筛候选框； 预处理结果缓冲模块，用于解决所述预处理模块与后继硬件电路处理速度不匹配的问题，降低发生阻塞概率； 仲裁模块，通过分析所述预处理模块内部存储体使用率，允许存储体使用率高的预处理模块优先将结果写入所述预处理结果缓冲模块； 多个串联的NMS单元，候选框数据将依次通过各个NMS单元进行处理，当处理完毕后，每个NMS单元将输出负责产生一个最终的输出框； 所述的NMS单元包括：候选框存储模块，交并比计算模块和候选框存储更新控制模块； 所述候选框存储模块，负责缓存候选框信息，根据候选框存储更新控制模块发出的控制信号，进行数据的写入或读出，最终输出框的数据将被保存在候选框存储模块中； 所述交并比计算模块，接受前驱NMS单元发送的当前输入候选框数据，以及从候选框存储模块中读出的临时候选框数据，计算候选框存储模块传递的临时候选框与当前输入候选框的交并比，即两候选框交集面积与两候选框并集面积之比，并将结果传递至候选框存储更新控制模块； 所述候选框存储更新控制模块，接受前驱NMS单元发送的当前输入候选框数据、从候选框存储模块中读出的临时候选框数据、从候选框存储模块中读出的排序框数据，生成状态信号，并根据交并比及状态信号，生成候选框存储模块的读写控制信号，在该读写控制信号的控制下，输出框数据将被写入候选框存储模块中。

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