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龙图腾网获悉杭州和利时自动化有限公司申请的专利一种支持、接收多DP主卡的控制器、方法、装置及介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116049083B 。

龙图腾网通过国家知识产权局官网在2025-12-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310182481.1，技术领域涉及：G06F15/17；该发明授权一种支持、接收多DP主卡的控制器、方法、装置及介质是由李宾;肖凯洋;燕荣设计研发完成，并于2023-03-01向国家知识产权局提交的专利申请。

本一种支持、接收多DP主卡的控制器、方法、装置及介质在说明书摘要公布了：本申请公开了一种支持、接收多DP主卡的控制器、方法、装置及介质，应用于数据传输领域。本申请所提供的一种支持多DP主卡的控制器，应用于多链路通信的分布式控制系统，该系统包括电子设备，主控制器和FPGA，其中，FPGA的一端连接电子设备，FPGA的另一端连接主控制器，用于获取需要的数据信息，根据数据信息的格式判断数据信息的来源，将数据信息进行转换，得到接口时序，将接口时序发送主控制器。本申请同一个控制器从站设备可以在多条链路上，可以兼顾高速与远距离传输，同时在测点较多的应用场景下性价比较高。

本发明授权一种支持、接收多DP主卡的控制器、方法、装置及介质在权利要求书中公布了：1.一种支持多DP主卡的控制器，其特征在于，应用于多链路通信的分布式控制系统，该系统包括电子设备，主控制器和FPGA；其中，所述FPGA的数量为所述多链路通信的分布式控制系统中具体链路数值的12，其中每一个所述FPGA支持两条链路的通信，且两条链路的通信互为冗余； 其中，所述FPGA的一端连接所述电子设备，所述FPGA的另一端连接所述主控制器，用于获取需要的数据信息，根据所述数据信息的格式判断所述数据信息的来源，将所述数据信息进行转换，得到读写时序，再对所述读写时序进行转换，得到接口时序，并将所述接口时序发送至所述主控制器； 所述FPGA包括：异步收发传输器，DP参数配置寄存器，双口RAM管理寄存器，并行总线处理接口，时序转换模块，双口RAM模块，ARM主卡，总线；其中，所述并行总线处理接口采用16bit数据及地址接口； 其中，所述异步收发传输器第一端连接所述电子设备，所述异步收发传输器的第二端连接所述DP参数配置寄存器的第一端； 所述DP参数配置寄存器的第二端连接所述双口RAM管理寄存器，所述DP参数配置寄存器的第三端连接所述时序转换模块； 所述双口RAM管理寄存器的第二端连接所述并行总线处理接口的第一端； 所述时序转换模块的第二端连接总线的第一端； 所述总线的第二端连接所述ARM主卡，所述总线的第三端连接所述双口RAM模块的第一端； 所述双口RAM模块的第二端连接所述并行总线处理接口的第二端； 所述并行总线处理接口的第三端连接所述主控制器。

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