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龙图腾网获悉浙江科睿微电子技术有限公司申请的专利分层译码方法、装置、终端设备及介质获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114499541B 。

龙图腾网通过国家知识产权局官网在2025-12-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210010615.7，技术领域涉及：H03M13/11；该发明授权分层译码方法、装置、终端设备及介质是由吴玉俊;吴斌;刘光熹设计研发完成，并于2022-01-05向国家知识产权局提交的专利申请。

本分层译码方法、装置、终端设备及介质在说明书摘要公布了：本发明公开了一种分层译码方法、装置、终端设备及介质，其中所述方法包括：对低密度奇偶校验码LDPC校验基矩阵进行分列重排序，得到排序校验基矩阵；对所述排序校验基矩阵进行分层重排序，得到最优校验基矩阵；根据所述最优校验基矩阵，对待译码的软信息进行译码，得到对应的译码信息。采用本发明，能解决现有技术中QC‑DPLC译码实现复杂度较高、难以满足链路传输延迟和吞吐量的要求等技术问题。

本发明授权分层译码方法、装置、终端设备及介质在权利要求书中公布了：1.一种分层译码方法，其特征在于，所述方法包括： 对低密度奇偶校验码LDPC校验基矩阵进行分列重排序，得到排序校验基矩阵； 对所述排序校验基矩阵进行分层重排序，得到最优校验基矩阵； 根据所述最优校验基矩阵，对待译码的软信息进行译码，得到对应的译码信息； 所述对所述排序校验基矩阵进行分层重排序，得到最优校验基矩阵包括以下步骤： S51、对所述排序校验基矩阵进行分层重排列，得到分层校验基矩阵； S52、将所述分层校验基矩阵中的前i列和后j列各自对应的矩阵，确定为第一基矩阵和第二基矩阵； S53、采用预设的读写分层算法，对所述第一基矩阵和所述第二基矩阵进行分层迭代计算，得到所述分层校验基矩阵的计算信息，所述计算信息包括单次迭代所需的时钟周期、时钟周期个数、读数据次序和写数据次序，所述读数据次序用于指示对所述分层校验基矩阵中各元素数据进行读取的读取次序，所述写数据次序用于指示对所述分层校验基矩阵中各元素数据进行写入的写入次序； S54、重调所述分层校验基矩阵中各层的层次序，重复执行步骤S52～S53，直到重复次数达到预设次数结束； S55、将单次迭代所需的时钟周期个数最小的所述分层校验基矩阵，确定为所述最优校验基矩阵； 所述根据所述最优校验基矩阵，对待译码的软信息进行译码，得到对应的译码信息包括以下步骤： S61、根据所述最优校验基矩阵中各列的列次数，对待译码的软信息进行重排序，得到排序软信息； S62、采用分层迭代译码算法，根据所述读数据次序和所述写数据次序对所述排序软信息进行双边低延迟分层迭代译码，得到对应的译码码字； S63、按照所述排序校验基矩阵中各列的列次序输出所述译码码字，得到所述译码信息； 应用于LDPC译码器，所述LDPC译码器包括第一缓存器Q_buffer_wrap、第一移位器、计算器、更新器PU_wrap、第二缓存器R_buffer_wrap、第三缓存器T_buffer_wrap、第二移位器和硬判译码器，所述方法还包括以下实施步骤： S71、根据所述最优校验基矩阵中各列的列次数，将所述待译码的软信息写入至所第一缓存器中； S72、通过所述第一移位器对所述第一缓存器中的所述待译码的软信息进行预设第一方向的移位； S73、通过所述计算器对移位后的所述待译码的软信息和所述第二缓存器中前次迭代译码中存储的校验节点更新信息进行计算，得到变量节点更新信息，并存储至所述更新器和所述第三缓存器； S73、通过所述更新器采用分层迭代译码算法，根据所述读数据次序、所述写数据次序及所述变量节点更新信息，计算所述变量节点对应的校验节点更新信息及所述待译码的软信息的更新信息； S74、通过所述第二移位器对所述待译码的软信息的变更信息进行预设第二方向的移位，所述预设第一方向与所述预设第二方向相反； S75、通过硬判译码器对所述待译码的软信息的更新信息进行硬判译码，得到对应的译码码字。

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