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龙图腾网获悉京东方科技集团股份有限公司申请的专利移位寄存器及驱动方法、栅极驱动电路和显示装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119649760B 。

龙图腾网通过国家知识产权局官网在2025-12-09发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202510125594.7，技术领域涉及：G09G3/3266；该发明授权移位寄存器及驱动方法、栅极驱动电路和显示装置是由卢江楠;商广良;刘利宾设计研发完成，并于2025-01-26向国家知识产权局提交的专利申请。

本移位寄存器及驱动方法、栅极驱动电路和显示装置在说明书摘要公布了：本公开的实施例提供了一种移位寄存器及驱动方法、栅极驱动电路和显示装置。涉及显示技术领域，用于提高显示面板的显示效果，移位寄存器包括第一输入子电路、第二输入子电路、第一输出子电路、第一存储子电路和第一控制子电路。第一输入子电路与信号输入端、第一节点和第一时钟信号端耦接；第二输入子电路与第一节点、第二节点和第一时钟信号端耦接；第一输出子电路与第二时钟信号端，第二节点和级联信号输出端耦接；第一控制子电路与第二时钟信号端、级联信号输出端和第一节点耦接；第一控制子电路被配置为，在输出阶段，响应于级联信号输出端处的工作电平，将第二时钟信号端处接收的工作电平传递至第一节点。上述移位寄存器用于驱动像素电路。

本发明授权移位寄存器及驱动方法、栅极驱动电路和显示装置在权利要求书中公布了：1.一种移位寄存器，其特征在于，包括： 第一输入子电路，与信号输入端、第一节点和第一时钟信号端耦接；所述第一输入子电路被配置为，在输入阶段，响应于所述第一时钟信号端处接收的第一时钟信号，将所述信号输入端处接收的工作电平传递至所述第一节点；以及在输出阶段，响应于所述第一时钟信号端处接收的第一时钟信号，将所述信号输入端和所述第一节点截止；在输出阶段，所述信号输入端处接收非工作电平；所述第一输入子电路包括第一晶体管，所述第一晶体管为低温多晶硅晶体管； 第二输入子电路，与所述第一节点、第二节点和所述第一时钟信号端耦接；所述第二输入子电路被配置为，在输入阶段，响应于所述第一时钟信号端处接收的第一时钟信号，将所述第一节点处的电压传递至所述第二节点，以及在输出阶段，响应于所述第一时钟信号端处接收的第一时钟信号，将所述第一节点和所述第二节点截止；所述第二输入子电路包括第二晶体管，所述第二晶体管为低温多晶硅晶体管； 第一输出子电路，与第二时钟信号端，所述第二节点和级联信号输出端耦接；所述第一输出子电路被配置为，在所述输入阶段，在所述第二节点处的电压的控制下，将所述第二时钟信号端处接收的非工作电平传递至级联信号输出端；以及在所述输出阶段，在所述第二节点处的电压的控制下，将所述第二时钟信号端处接收的工作电平传递至级联信号输出端； 第一存储子电路，与所述第二节点和所述级联信号输出端耦接；所述第一存储子电路被配置为，在所述输入阶段，存储所述第二节点处的电压，以及在所述输出阶段，将所述第二时钟信号端处接收的工作电平和非工作电平的差值，写入所述第二节点； 第一控制子电路，与所述第二时钟信号端、所述级联信号输出端和所述第一节点耦接； 所述第一控制子电路被配置为，在所述输出阶段，响应于所述级联信号输出端处的工作电平，将所述第二时钟信号端处接收的工作电平传递至所述第一节点；所述第一控制子电路包括第三晶体管，所述第三晶体管的第一极与所述第二时钟信号端连接，第二极与所述第一节点连接，控制极与所述级联信号输出端连接； 第三输入子电路，与第一电压信号端，第三节点和第四节点耦接；所述第三输入子电路被配置为，在所述输入阶段，在所述第四节点的电压的控制下，将所述第一电压信号端处接收的第一电压信号传递至所述第三节点；所述第一电压信号为非工作电平； 第二控制子电路，与所述第二节点、所述第三节点、所述第一电压信号端、第二电压信号端和第三时钟信号端耦接；所述第二控制子电路被配置为，在保持阶段，响应于所述第三时钟信号端处接收的第三时钟信号，将所述第二电压信号端处接收的第二电压信号传递至所述第三节点，以及将所述第一电压信号端处接收的第一电压信号传递至所述第二节点； 所述第二电压信号为工作电平； 第二输出子电路，与第三电压信号端，第三节点和所述级联信号输出端耦接；所述第二输出子电路被配置为，在保持阶段，在所述第三节点处的电压的控制下，将第三电压信号端处接收的第三电压信号传递至所述级联信号输出端；所述第三电压信号为非工作电平； 所述第二控制子电路包括： 一级控制子电路，与所述第三节点、所述第二电压信号端和所述第三时钟信号端耦接； 所述一级控制子电路被配置为，在所述保持阶段，响应于所述第三时钟信号端处接收的第三时钟信号，将所述第二电压信号端处接受的第二电压信号传递至所述第三节点；所述第二电压信号为工作电平； 二级控制子电路，与所述第二节点、所述第三节点和所述第一电压信号端耦接；所述二级控制子电路被配置为，在所述保持阶段，在所述第三节点处的第二电压信号的控制下，将第一电压信号端处接收的第一电压信号传递至所述第二节点；所述二级控制子电路包括： 第一子电路，与所述第三节点、所述第一电压信号端和第五节点耦接；所述第一子电路被配置为，在所述输出阶段，在所述第三节点处的电压的控制下，将所述第一电压信号端和所述第五节点截止；所述第一子电路包括第四晶体管，所述第四晶体管为低温多晶硅晶体管； 第二子电路，与所述第二节点、所述第三节点和所述第五节点耦接；所述第二子电路被配置为，在所述输出阶段，在所述第三节点处的电压的控制下，将所述第五节点和所述第二节点截止；所述第二子电路包括第五晶体管，所述第五晶体管为低温多晶硅晶体管； 三级控制子电路，与所述第五节点、所述第二节点和所述第二电压信号端耦接；所述三级控制子电路被配置为，在所述输出阶段，在所述第二节点处的电压的控制下，将所述第二电压信号端处接收的第二电压信号传递至所述第五节点。

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