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龙图腾网获悉电子科技大学申请的专利一种基于窄脉冲的电力线时间同步装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115913440B 。

龙图腾网通过国家知识产权局官网在2025-11-25发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211660781.8，技术领域涉及：H04J3/06；该发明授权一种基于窄脉冲的电力线时间同步装置是由侯冬;李泽;郭广坤;付在明;刘科设计研发完成，并于2022-12-23向国家知识产权局提交的专利申请。

本一种基于窄脉冲的电力线时间同步装置在说明书摘要公布了：本发明公开了一种基于窄脉冲的电力线时间同步装置，通过构建时间编码，然后处理端生成相应的控制信号控制窄脉冲信号的输出与否来产生在电力线上传输的加载有时间编码的脉冲串，最后放大、隔离后耦合到电力线上传输。同时，通过耦合、隔离、脉冲检测获得对端发送来的脉冲串。这样，通过发送时刻与接收时刻的时间计数值，可以获得秒内的时间差Δt，A端、B端的处理端根据接收到的对端时间结合自己的时间，对秒时间进行同步，然后结合时间差Δt同步秒内时间。本发明设计的一种全新的基于窄脉冲的电力线传输时间编码，并利用高稳脉冲以及双向时间对比方法进行电力线时间同步，并基于此设计了一套硬件系统，克服了电力线恶劣信道的限制，提高了电力线时间同步的精度。

本发明授权一种基于窄脉冲的电力线时间同步装置在权利要求书中公布了：1.一种基于窄脉冲的电力线时间同步装置，包括需要进行时间同步的两个位于不同位置的电力系统授时设备，分别为A端、B端； 其特征在于，每个电力系统授时设备包括处理端、发送端以及接收端，其中： 处理端用于生成带有时间编码的控制信号，时间编码为一秒一帧，每一帧由时间片组成，时间片又由多个码元组成，每个码元的时间长度为10ms，每个码元中有脉冲表示逻辑“1”，无脉冲表示逻辑“0”； 时间片包含帧头、秒个位、秒十位、分个位、分十位、时个位、时十位、日个位、日十位、月个位、月十位、年个位、年十位、以及帧尾，其中帧头以8个码元“FF”作为开始标志，帧尾以8个码元“AA”作为结束标志，其余时间片均包含4个码元，时间编码顺序低位在前，高位在后； 发送端由脉冲合成模块、隔离器以及耦合器构成； 在脉冲合成模块中，首先，脉冲产生模块产生两路完全一致的脉冲信号，分别送入窄延时模块和宽延时模块进行延时，输出两路除了有极短相位差外完全一致的脉冲信号，然后，合成电路通过两脉冲的极短相位差生成窄脉冲信号，并通过波形调理模块对脉冲的波形进行处理和边沿压缩，产生快边沿的、10ns的窄脉冲信号，然后，通过处理端输入控制信号对开关模块进行控制，通过控制窄脉冲信号的输出与否来产生在电力线上传输的加载有时间编码的脉冲串，最后，放大电路将脉冲串的幅值放大，使之适宜于在电力线上传输，放大后的脉冲串输出到隔离器； 在隔离器中，对脉冲串进行隔离后送入到耦合器，耦合到电力线上； 相应地，接收端由耦合器、隔离器以及脉冲检测模块构成； 耦合器将来自对端的电力线上的脉冲串耦合下来，经过隔离器隔离后送入到脉冲检测模块中； 在脉冲检测模块中，峰值检测模块利用电容充电进行峰值检测，检测到峰值即脉冲串的脉冲后进行保持，峰值检测得到的电压送到比较模块，比较模块预先设置了阈值，若超过阈值，则认为检测到了脉冲，输出TTL电平，送到FPGA模块，在脉冲串的下一个脉冲来临前，峰值检测模块的电容放电完毕，峰值检测得到的电压低于阈值，比较模块输出0电平，当脉冲串的下一个脉冲来时，再重新输出TTL电平，循环上述过程，获得加载有时间编码的脉冲串； 处理端对加载有时间编码的脉冲串进行处理，获得时间编码； A端、B端分别通过各自的处理端、发送端以及接收端进行加载有自己时间编码的脉冲串的发送并接收对端加载有对端时间编码的脉冲串，然后解码出对端时间； A端、B端的处理端分别有计数器，在自己发送加载有时间编码的脉冲串时，开始计数，在接收到对端加载有时间编码的脉冲串时，停止计数，其中，开始计数为：发送帧头第一位的上升沿时开始计数，停止计数为：收到对端发送帧头第一位的上升沿时停止计数，这样在A端得到计数值TAB，在B端得到计数值TBA，这样，得到B端相对与A端落后的时间差Δt： ； 其中，τAB为A端到B端路径传播时延，τBA为B端到A端路径传播时延，且τAB=τBA，具体数值忽略； τTB、τRB为B端发射设备与接收设备的硬件时延、τTA、τRA为A端发射设备与接收设备的硬件时延，这些硬件时延都可以通过事先标定得到； A端、B端的处理端根据接收到的对端时间结合自己的时间，对秒时间进行同步，然后结合时间差Δt同步秒内时间。

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