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龙图腾网获悉中国科学院微电子研究所申请的专利一种多相位时钟生成电路和时钟调相方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN114567307B 。

龙图腾网通过国家知识产权局官网在2025-11-18发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210089068.6，技术领域涉及：H03K5/15；该发明授权一种多相位时钟生成电路和时钟调相方法是由吴雪莹;管武;邱昕;郑旭强设计研发完成，并于2022-01-25向国家知识产权局提交的专利申请。

本一种多相位时钟生成电路和时钟调相方法在说明书摘要公布了：本发明提供了一种多相位时钟生成电路和时钟调相方法，所述多相位时钟生成电路包括：四相信号生成模块，对输入信号进行T4，T2，3T4的延时，得到具有0°，90°，180°，270°相移的四相信号，并输出给数字移相模块；控制码生成模块，设定控制码信号，并输出给数字移相模块；数字移相模块，接收所述四相信号和控制码信号，以使用所述控制码信号调整所述四相信号。本发明设计高速时钟信号相位调制装置，实现3.5Gsps以上信号的比较，解决了高速时钟信号的调相问题。

本发明授权一种多相位时钟生成电路和时钟调相方法在权利要求书中公布了：1.一种多相位时钟生成电路，其特征在于，包括： 四相信号生成模块，对输入信号进行T4，T2，3T4的延时，得到具有0°，90°，180°，270°相移的四相信号，并输出给数字移相模块； 控制码生成模块，设定控制码信号，并输出给数字移相模块； 数字移相模块，接收所述四相信号和控制码信号，以使用所述控制码信号调整所述四相信号； 所述数字移相模块由电阻合成模块、双路差分放大模块、多输出恒流源模块组成，所述双路差分放大模块包括7个第一差分放大模块和9个第二差分放大模块，所述多输出恒流源模块包括两个七输出恒流源模块和一个九输出恒流源模块，其中，每个第一差分放大模块连接并由七输出恒流源模块供电，每个第二差分放大模块连接并由九输出恒流源模块供电； 所述第一差分放大模块，包括14个MOSFET晶体管，分为三级，第一级包括八个晶体管，两两为一组组成电流镜偏置电路，每组中的两个晶体管的漏极各自连接电阻合成模块两个输出端中的一个，每组中的两个晶体管的源极之间连接并连接一个第二级晶体管的漏极；第二级晶体管为四个，分为两组，每组两个晶体管，每个组内两个晶体管的源极之间连接并连接一个第三级晶体管的漏极，并且每组第二级晶体管的其中一个晶体管的栅极连接一个反相器；第三级晶体管为两个，且每个第三级晶体管的漏极各自连接一个七输出恒流源模块； 所述第二差分放大模块，包括14个MOSFET晶体管，分为三级，第一级包括八个晶体管，两两为一组组成电流镜偏置电路，每组中的两个晶体管的漏极各自连接电阻合成模块两个输出端中的一个，每组中的两个晶体管的源极之间连接并连接一个第二级晶体管的漏极；第二级晶体管为四个，分为两组，每组两个晶体管，每个组内两个晶体管的源极之间连接并连接一个第三级晶体管的漏极，并且每组第二级晶体管的其中一个晶体管的栅极连接一个反相器；第三级晶体管为两个，其中一个第三级晶体管的栅极也连接一个反相器，并且两个第三级晶体管的漏极均连接同一个九输出恒流源模块； 所述七输出恒流源模块包括四个MOSFET晶体管及一个电阻组成的电流镜偏置电路，以及七个并联的MOSFET，所述七个并联的MOSFET中每个MOSFET的漏极输出一路恒流输出给一个第一双路差分放大模块； 所述九输出恒流源模块，包括四个MOSFET晶体管及一个电阻组成的电流镜偏置电路，以及九个并联的MOSFET，九个并联的MOSFET中每个MOSFET的漏极输出一路恒流输出给一个第二双路差分放大模块； 所述电阻合成模块包括两个并联的大小相同的电阻。

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