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龙图腾网获悉西北大学申请的专利一种双模切换的Buck变换器获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119652072B 。

龙图腾网通过国家知识产权局官网在2025-10-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411809466.6，技术领域涉及：H02M1/00；该发明授权一种双模切换的Buck变换器是由赵武;赵珂楠;李强;刘腾飞;孟一涵;吴俊凯;张炜康;马晓龙;齐晓斐;张远;戴琨;田瑞卓;杨东东设计研发完成，并于2024-12-10向国家知识产权局提交的专利申请。

本一种双模切换的Buck变换器在说明书摘要公布了：本发明适用于开关电源技术领域，提供了一种双模切换的Buck变换器，本发明通过在环路中增加HVTHighVoltageThreshold模块控制功率管的导通与关断，实现对系统保护功能和低功耗模式。HVT模块通过比较输出反馈电压VFB与参考电压Vref，在软启动阶段可以快速关断上下功率管，有效的避免系统发生瞬态过电压时导致芯片烧毁；在PFM模式下，通过关断功率管减少导通损耗开启低功耗模式；同时可以在触发限流ILIM机制时，关闭上功率管打开下功率管，释放环路中多余的电流防止发生回流现象。本发明实现Buck变换器重载PWM、轻载PFM双模式切换控制策略，在实现提高整体工作效率的同时，能有效的提高变换器的稳定性，增加ECO节能模式降低系统功耗。

本发明授权一种双模切换的Buck变换器在权利要求书中公布了：1.一种双模切换的Buck变换器，包括逻辑驱动电路、栅极驱动单元、功率管、输入\输出电路，其特征在于，误差放大器的正输入端接内部基准电压，负输入端接反馈电压，误差放大器输出端接PWM比较器的负输入端；上功率管源端接输入电压，下功率管的源端接地，上下功率管的漏端相接；电感电流检测电路采样流经功率管的电流，输出端接斜坡补偿电路；振荡器的一个输出端接与门的一个输入端，另一个输出端接斜坡补偿电路；斜坡补偿电路输出端接PWM比较器，PWM比较器的输出端接RS触发器R输入端；ZCD的正输入端接功率管漏端，负输入端接地，一个输出端接D触发器D输入端，另一个输出端接非门的输入端；HVT模块的一个输入端接内部基准电压，另一个输入端接反馈电压，输出端接或非门的输入端；非门的输出端接或非门的另一个输入端；或非门的输出端接与门的另一个输入端；与门的输出端接RS触发器的S输入端；上功率管的栅极接反相器的输入端，反相器的输出端接D触发器的CLK端；限流模块的输入端接功率管的漏端；RS触发器的Q输出端、D触发器的Q输出端和限流模块的输出端均接逻辑驱动电路的输入端，在三者的协同作用下，输出脉冲信号到栅极驱动单元；栅极驱动单元分别连接上下功率管的栅端，功率管漏端连接输出电路； 所述D触发器的时钟通过采集上功率管开关信号的反相电压得到，ZCD的输出信号作为D端输入； 所述PWM比较器的输出为一级RESET信号，所述限流模块在输出过流情况下为二级RESET信号，一级RESET信号和二级RESET信号通过关闭功率管去适配系统不同工作模式； 所述ZCD电路与D触发器共同组成PWM模式切换PFM模式的控制电路，通过设置合理次数，系统判定进入轻载状态，进入PFM工作模式； 所述HVT模块包括十个PMOS管、十五个NMOS管、三个电阻，其中：第一PMOS管MP1的源极、第二PMOS管MP2的源极、第五PMOS管MP5的源极、第六PMOS管MP6的源极、第七NMOS管MN7的源极、第八MOS管MP8的源极、第九PMOS管MP9的源极和第十PMOS管的源极与电源VCC连接；第三NMOS管MN3的源极、第二NMOS管MN2的源极、第五NMOS管MN5的源极、第八NMOS管MN8的源极、第十一NMOS管MN11的源极、第十四NMOS管MN14和第十五NMOS管MN15的源极与地连接；第三NMOS管MN3的栅极、第五NMOS管MN5的栅极和第八NMOS管MN8的栅极与第十一NMOS管的栅极连接； 第一PMOS管MP1，栅极与第二PMOS管MP2的栅极连接，源极与偏置电压IBIAS连接；第二PMOS管MP2，漏极与第三PMOS管MP3的源极连接；第三PMOS管MP3，栅极与第二PMOS管MP2的栅极连接，漏极与第一NMOS管MN1的漏极连接；第一NMOS管MN1，栅极与漏极连接，源极与第三NMOS管MN3的漏极连接；第三NMOS管MN3的栅极与漏极连接；第四PMOS管MP4，栅极与输出端VOUT连接，源极第六PMOS管MP6的漏极连接，漏极与第二NMOS管MN2的漏极连接；第二NMOS管MN2，栅极与第一NMOS管MN1的栅极连接；第四NMOS管MN4，漏极与第六PMOS管MP6的漏极连接，栅极与第一NMOS管MN1的栅极连接；第五NMOS管MN5，漏极与第六PMOS管MP6的漏极连接；第一电阻R1跨接在第四PMOS管MP4的源极、第四NMOS管MN4的漏极和第五NMOS管MN5的漏极与第六PMOS管MP6的漏极之间；第五PMOS管MP5，栅极与漏极连接，漏极与第六NMOS管MN6的漏极连接；第二电阻R2跨接在第五PMOS管MP5的漏极与第六NMOS管MN6的漏极之间；第六PMOS管MP6，栅极与漏极连接，漏极与第七NMOS管MN7的漏极连接；第三电阻R3跨接在第六PMOS管MP6的漏极与第七NMOS管MN7的漏极之间；第六NMOS管MN6，栅极与输入信号VIP连接，源极与第七NMOS管MN7的源极连接；第七NMOS管MN7，栅极与输入信号VIN连接；第八NMOS管MN8，漏极与第六NMOS管MN6的源极和第七NMOS管MN7的源极连接；第七PMOS管MP7，栅极与第十PMOS管MP10的栅极连接，漏极与第九NMOS管MN9的漏极连接；第八PMOS管MP8，栅极与漏极连接，漏极与第十NMOS管MN10的漏极连接；第九NMOS管MN9，栅极与第七NMOS管的漏极连接，源极与第十NMOS管MN10的源极连接；第十NMOS管MN10，栅极与第六NMOS管MN6的漏极连接；第十一NMOS管MN11，源极与第九NMOS管MN9的源极和第十NMOS管的源极连接；第九PMOS管MP9，栅极与第八PMOS管MP8的栅极连接，漏极与第12NMOS管MN12的漏极连接；第十PMOS管MP10，漏极与第十三NMOS管MN13的漏极连接；第十二NMOS管MN12，栅极与漏极连接，源极与第十四NMOS管MN14的漏极连接；第十三NMOS管MN13，栅极与第十二NMOS管MN12的栅极连接，源极与第十五NMOS管MN15的漏极连接；第十四NMOS管MN14，漏极与栅极连接；第十五NMOS管MN15，栅极与第十四NMOS管MN14的栅极连接；输出端VOUT由第十PMOS管MP10的漏极和第十三NMOS管MN13的漏极之间引出。

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