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龙图腾网获悉上海交通大学申请的专利面向CGRA的多精度小面积SIMD运算系统、方法、介质及设备获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115904507B 。

龙图腾网通过国家知识产权局官网在2025-10-17发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211411460.4，技术领域涉及：G06F9/38；该发明授权面向CGRA的多精度小面积SIMD运算系统、方法、介质及设备是由王琴;郑国浩;孔尧尧;蒋剑飞;景乃锋;绳伟光;毛志刚设计研发完成，并于2022-11-11向国家知识产权局提交的专利申请。

本面向CGRA的多精度小面积SIMD运算系统、方法、介质及设备在说明书摘要公布了：本发明提供了一种面向CGRA的多精度小面积SIMD运算系统、方法、介质及设备，包括编码模块、累加模块和溢出处理模块，编码模块由编码单元、选择器和解码选择单元组成，通过基于Booth算法进行编码操作，并基于模式选择进行数据的解码得到部分积结果；累加模块由多块部分积压缩组成，基于模式选择将不同块的部分积压缩结果进行求和拼接；溢出处理模块通过将累加模块结果进行溢出处理，得到最后的截位数据。本发明的工作精度可以配置，能够支持目前主流的32比特和8比特位宽神经网络应用的高速部署工作，拥有较高的资源利用率，另外通过三级流水的方式进行数据运算处理，保证了1GHz的工作频率。

本发明授权面向CGRA的多精度小面积SIMD运算系统、方法、介质及设备在权利要求书中公布了：1.一种面向CGRA的多精度小面积SIMD运算系统，其特征在于，包括编码模块、累加模块和溢出模块； 所述编码模块包括编码单元、选择器Mux和解码单元Select； 所述编码单元用于将原始的被乘数X通过Booth编码操作得到S、D和N参数； 所述选择器用于选择不同精度和符号模式中模式的编码模块数据走向； 所述解码单元用于将编码得到的S、D和N参数与乘数Y进行解码操作，得到每行部分的部分积结果； 所述S、D和N参数为被乘数X的编码结果，其中S代表32位单精度格式Single，输出结果为±1；D为64位双精度格式Double，输出结果为±2；N为否定符号Negation，代表操作的符号位； 所述累加模块用于按预设时序进行编码后累加乘法部分积和累加乘法结果； 所述溢出模块用于根据预设规则进行低位截位、高位截位和饱和截位； 所述解码单元的输入信号为S、D、N和乘数Y组合而成，采用32位Booth乘法运算复用4个8位Booth乘法运算，在8位Booth运算中，在边界编码单元处设有选择器选择是否进行32位运算； 编码模块产生部分积的过程为： 基于选择器选择的数据走向后，对数据进行分组，然后将编码结果S、D和N参数与乘数Y放入解码模块中，得到部分积PP，引入参数j代表部分积PP的每位数据，其中j取值为0～7的整数； 部分积PP与编码结果和乘数Y的关系表达式为：PPj＝～～Yjamp;Damp;～Yj-1amp;S^N，其中，PP0＝～Samp;Y0^N。

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