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龙图腾网获悉中国人民解放军国防科技大学申请的专利一种可控码间串扰的双二进制数据传输装置获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN116346554B 。

龙图腾网通过国家知识产权局官网在2025-09-30发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202310315678.8，技术领域涉及：H04L25/03；该发明授权一种可控码间串扰的双二进制数据传输装置是由胡小月;吕方旭;王强;张庚;赖明澈;庞征斌;罗章;许超龙;李萌;齐星云;徐佳庆设计研发完成，并于2023-03-28向国家知识产权局提交的专利申请。

本一种可控码间串扰的双二进制数据传输装置在说明书摘要公布了：本发明公开了一种可控码间串扰的双二进制数据传输装置，本发明包括发射机和接收机，其中发射机包括：预编码模块，用于通过预编码消除多路并行低速源信号前后符号间的相关性；前馈均衡器FFE，用于进行信道损耗补偿；并串转换模块，用于将多路并行低速源信号合成为数量更少的多路串行高速信号；高速合成器，用于将多路串行高速信号合成一路数据流；发射驱动电路，用于将数据流采用双二进制数据的形式输出；以及时钟单元，用于基于外部输入的时钟源提供时钟信号。本发明在传输过程中使用预编码的方式引入可控的码间干扰，对于对信号带宽以及后续均衡器性能的需求较低。

本发明授权一种可控码间串扰的双二进制数据传输装置在权利要求书中公布了：1.一种可控码间串扰的双二进制数据传输装置，包括发射机和接收机，其特征在于，所述发射机包括： 预编码模块，用于通过预编码消除多路并行低速源信号前后符号间的相关性； 前馈均衡器FFE，用于进行信道损耗补偿； 并串转换模块，用于将多路并行低速源信号合成为数量更少的多路串行高速信号； 高速合成器，用于将多路串行高速信号合成一路数据流； 发射驱动电路，用于将数据流采用双二进制数据的形式输出； 以及时钟单元，用于基于外部输入的时钟源提供时钟信号； 所述预编码模块、前馈均衡器FFE、并串转换模块、高速合成器以及发射驱动电路依次相连且所述预编码模块的输入端用于与信号生成模块相连，所述发射驱动电路的输出用于输出编码后得到的双二进制数据，所述时钟单元的输出端分别与预编码模块、前馈均衡器FFE、并串转换模块、高速合成器的时钟信号输入端相连； 所述接收机中，接收驱动电路的输入端与输入信号源相连、输出端依次通过连续时间线性均衡器CTLE、可变增益放大器VGA、判断反馈均衡器DFE以及切片器将解码信号Dn输出给对应的信号接收模块；所述连续时间线性均衡器CTLE为互补对称结构的连续时间线性均衡器CTLE，所述互补对称结构的连续时间线性均衡器CTLE包括PMOS管Mp1~Mp4、NMOS管Mn1~Mn4、可调退化电阻RS、退化电容CS以及用于产生偏置电压VBP和偏置电压VBn的偏置电压产生电路，PMOS管Mp3、PMOS管Mp1、NMOS管Mn1、NMOS管Mn3通过源极和漏极首尾相连并串接在电源VDD和地GND之间，PMOS管Mp4、PMOS管Mp2、NMOS管Mn2、NMOS管Mn4通过源极和漏极首尾相连并串接在电源VDD和地GND之间，PMOS管Mp3和PMOS管Mp4两者的栅极连接偏置电压VBP、漏极之间并联有一组可调退化电阻RS和退化电容CS，PMOS管Mp1、NMOS管Mn1两者的栅极连接输入差分信号VIN和VIP中的信号VIP，PMOS管Mp2、NMOS管Mn2两者的栅极连接输入差分信号VIN和VIP中的信号VIN，NMOS管Mn3和NMOS管Mn4两者的栅极连接偏置电压VBn、漏极之间并联有另一组可调退化电阻RS和退化电容CS，所述可调退化电阻RS包括并联连接且阻值大小不同的多条电阻支路，每一条电阻支路中包括开关管和串联在开关管两侧阻值大小相同的电阻。

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