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龙图腾网获悉西安理工大学申请的专利基于单斜式与电平编码TDC的两步式高速ADC电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115333542B 。

龙图腾网通过国家知识产权局官网在2025-09-26发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210947881.2，技术领域涉及：H03M1/56；该发明授权基于单斜式与电平编码TDC的两步式高速ADC电路是由郭仲杰;王杨乐;许睿明;刘绥阳;郭优美;王彬;林涛设计研发完成，并于2022-08-08向国家知识产权局提交的专利申请。

本基于单斜式与电平编码TDC的两步式高速ADC电路在说明书摘要公布了：本发明公开了一种基于单斜式与电平编码TDC的两步式高速ADC电路，其特征在于：包括单斜式数字逻辑ADC电路和时间数字转换TDC电路，单斜式数字逻辑电路的输出与时间数字转换TDC电路的输出通过累加器输出整体电路模数转换的结果OUT。本发明中TDC采用循环式电平编码方式，能够自动向单斜计数逻辑完成进位功能，并有效的兼容数字相关双采样技术，将两次带有非理想因素的量化结果做差，得到更精准的量化结果。

本发明授权基于单斜式与电平编码TDC的两步式高速ADC电路在权利要求书中公布了：1.基于单斜式与电平编码TDC的两步式高速ADC电路，其特征在于：包括单斜式数字逻辑ADC电路和时间数字转换TDC电路，单斜式数字逻辑电路的输出与时间数字转换TDC电路的输出通过累加器输出整体电路模数转换的结果OUT； 所述单斜式数字逻辑ADC电路包括比较器CMP1，比较器CMP1的输出端C连接数字逻辑电路，比较器CMP1的另一输出端START连接时间数字转换TDC电路； 所述数字逻辑电路包括触发器DFF1，触发器DFF1的D端接控制信号clk_sam，触发器DFF1的CLK端与比较器CMP1的输出端C连接； 还包括反相器inv1，反相器inv1的输入端接控制信号ramp_L，反相器inv1的输出端与触发器DFF1的Q端共同接与门AND的输入端，与门AND的输出端接计数器COUNTER的输入端，计数器COUNTER的输出N2输出单斜式数字逻辑ADC电路进行双采样后的实际转换结果； 所述时间数字转换TDC电路包括能够产生延迟时钟CLK1和CLK2的DLL，CLK1和CLK2接异或门XOR的输入端，XOR的输出接反相器inv2的输入端，反相器inv2的输出端接触发器DFF2的输入端D，触发器DFF2的输出Y0作为相关双采样计数逻辑的最低位，触发器DFF2的CLK端接比较器CMP1的输出端START； 所述CLK1同时接反相器inv3的输入端，反相器inv3的输出端接触发器DFF3的输入端D，触发器DFF3的CLK端接比较器CMP1的输出端START；触发器DFF3的输出Y1作为相关双采样计数逻辑的次低位； 所述计数器COUNTER的输出N2、触发器DFF2的输出Y0及触发器DFF3的输出Y1通过累加器输出整体电路模数转换的结果OUT。

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