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龙图腾网获悉浙江大学申请的专利一种基于嵌入式CCIA和混合型DSM的读出电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN118971889B 。

龙图腾网通过国家知识产权局官网在2025-09-26发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411091616.4，技术领域涉及：H03M3/00；该发明授权一种基于嵌入式CCIA和混合型DSM的读出电路是由张辉柱;唐中;虞小鹏设计研发完成，并于2024-08-09向国家知识产权局提交的专利申请。

本一种基于嵌入式CCIA和混合型DSM的读出电路在说明书摘要公布了：本发明公开了一种基于嵌入式CCIA和混合型DSM的读出电路。该读出电路包括嵌入式CCIA和混合型DSM，嵌入式CCIA嵌于混合型DSM的环路中，将嵌入式CCIA的虚地点作为输入差分信号和反馈差分信号的求和节点。混合型DSM包括RC积分器、第一SC积分器、第二SC积分器、1.5位量化器以及反馈DAC。其中，RC积分器是CT积分器，降低了对CCIA的带宽要求；SC积分器是DT积分器，降低了对过量环路延时和RC系数变化的敏感性，并且能够减少PVT的影响，提高ROIC的鲁棒性。混合型DSM有利于实现高能效高精度读出电路。

本发明授权一种基于嵌入式CCIA和混合型DSM的读出电路在权利要求书中公布了：1.一种基于嵌入式CCIA和混合型DSM的读出电路，其特征在于，包括嵌入式CCIA和混合型DSM； 所述嵌入式CCIA嵌于所述混合型DSM的环路中，将嵌入式CCIA的虚地点作为输入差分信号和反馈差分信号的求和节点； 混合型DSM包括RC积分器、第一SC积分器、第二SC积分器、1.5位量化器以及反馈DAC； 读出电路的输入差分信号和反馈DAC输出的反馈差分信号输入嵌入式CCIA进行求和并放大，输出第一中间差分信号； 嵌入式CCIA输出的第一中间差分信号与DB控制时钟一起输入RC积分器，输出第二中间差分信号； RC积分器输出的第二中间差分信号与两相非交叠时钟和一起输入第一SC积分器，在两相非交叠时钟和的控制下对第二中间差分信号进行采样积分，输出第三中间差分信号； 第一SC积分器输出的第三中间差分信号与两相非交叠时钟和一起输入第二SC积分器，在两相非交叠时钟和的控制下对第三中间差分信号进行采样积分，并对RC积分器输出的第二中间差分信号和第一SC积分器输出的第三中间差分信号进行求和，输出第四中间差分信号； 第二SC积分器输出的第四中间差分信号与时钟一起输入1.5位量化器，由时钟控制1.5位量化器对第二SC积分器输出的第四中间差分信号进行量化，最终得到2位数字输出信号；该2位数字输出信号作为读出电路的最终输出，同时控制反馈DAC输出差分信号的正负性；所述2位数字输出信号与RZDAC的控制时钟、斩波时钟、DAC的参考差分信号和一起输入反馈DAC中，生成反馈差分信号； 所述嵌入式CCIA包括第一输入电容（）、第二输入电容（）、第一反馈电容（）、第二反馈电容（）、第一斩波开关（CHOP1）、第三斩波开关（CHOP3）和第一运算放大器（OTA1）； 所述反馈DAC包括第一DAC电容（）、第二DAC电容（）和第二斩波开关（CHOP2）； 第一斩波开关（CHOP1）的输入为外部的输入差分信号和以及斩波时钟； 第一输入电容（）的下极板接第一斩波开关（CHOP1）的一个输出端，上极板接第一运算放大器（OTA1）的正输入端； 第二输入电容（）的下极板接第一斩波开关（CHOP1）的另一个输出端，上极板接第一运算放大器（OTA1）的负输入端； 第一运算放大器（OTA1）的正输出端和负输出端分别连接第三斩波开关（CHOP3）的两个输入端； 第一反馈电容（）的上极板接第一运算放大器（OTA1）的正输入端，下极板接第三斩波开关（CHOP3）的一个输出端； 第二反馈电容（）上极板接第一运算放大器（OTA1）的负输入端，下极板接第三斩波开关（CHOP3）另一个输出端； 第二斩波开关（CHOP2）的第一输入为差分形式的片外参考信号和，第二个输入为1.5位量化器（Quantizer）的量化结果，第三个输入为RZDAC的控制时钟，第四个输入为斩波时钟； 第一DAC电容（）上极板接第一运算放大器（OTA1）的正输入端，下极板接第二斩波开关（CHOP2）的输出； 第二DAC电容（）上极板接第一运算放大器（OTA1）的负输入端，下极板接第二斩波开关（CHOP2）的输出。

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