意法半导体国际有限公司V·N·斯里尼瓦桑获国家专利权
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龙图腾网获悉意法半导体国际有限公司申请的专利针对基于锁存器的存储器来减少面积的ATPG测试方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115701876B 。
龙图腾网通过国家知识产权局官网在2025-09-19发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210882726.7，技术领域涉及：G11C29/14；该发明授权针对基于锁存器的存储器来减少面积的ATPG测试方法是由V·N·斯里尼瓦桑;B·S·索尼;A·K·戈亚尔设计研发完成，并于2022-07-26向国家知识产权局提交的专利申请。
本针对基于锁存器的存储器来减少面积的ATPG测试方法在说明书摘要公布了：本公开的实施例涉及针对基于锁存器的存储器来减少面积的ATPG测试方法。本文公开了逻辑电路和技术，逻辑电路和技术用于操作该硬件，以使得能够从锁存器构建先进先出FIFO缓冲器，同时允许对那些锁存器的使能引脚进行固定1stuck‑at‑1故障测试，以及测试通过FIFO缓冲器的各个点处的数据路径。
本发明授权针对基于锁存器的存储器来减少面积的ATPG测试方法在权利要求书中公布了：1.一种在功能模式和测试模式中操作的系统，所述系统包括： 写入数据寄存器，通过时钟信号来计时，并且被配置为存储待写入数据； 读取数据寄存器，通过所述时钟信号来计时，并且被配置为在其中存储所读取的数据； 先进先出FIFO缓冲器，由锁存器组组成，所述锁存器组通过使能信号来使能，并且所述锁存器组被布置为存储多个字，其中每次由写入地址信号可选择一个字来将所述数据从所述写入数据寄存器写入所述锁存器组，并且每次由读取地址信号可选择一个字来将所述锁存器组中存储的数据读出到所述读取数据寄存器中； 控制电路装置，被配置为接收写入请求信号和所述写入地址信号，并且生成写入使能信号； 其中所述控制电路装置还被配置为接收读取请求信号和所述读取地址信号，并且生成读取使能信号；以及 胶合逻辑，被配置为至少从所述写入使能信号生成内部写入使能信号，并且至少从所述读取使能信号生成内部读取使能信号； 其中当所述系统处于所述功能模式时，所述FIFO缓冲器的所述锁存器组由所述写入使能信号和所述读取使能信号使能；并且 其中当所述系统处于所述测试模式时，所述FIFO缓冲器的所述锁存器组由所述内部写入使能信号和所述内部读取使能信号使能。
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2、报告中的分析和结论仅反映本公司于发布本报告当日的职业理解，仅供参考使用，不能作为本公司承担任何法律责任的依据或者凭证。
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