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龙图腾网获悉天津普智芯网络测控技术有限公司申请的专利一种实现自由逻辑的pattern生成和运行方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119322612B 。

龙图腾网通过国家知识产权局官网在2025-09-16发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411864870.3，技术领域涉及：G06F8/30；该发明授权一种实现自由逻辑的pattern生成和运行方法是由薛良;张大伟;屈粮富;马慧娟设计研发完成，并于2024-12-18向国家知识产权局提交的专利申请。

本一种实现自由逻辑的pattern生成和运行方法在说明书摘要公布了：本发明提供一种实现自由逻辑的pattern生成和运行方法，包括获取被测芯片的测试信息，基于程序语言编辑程序文本以生成第一pattern文件；上位机基于转换表将文本格式的第一pattern文件转换成机器语言形式的第二pattern文件，第二pattren文件下发至测试机。本发明能够基于程序语言自由编辑第一pattern文件，并将其转换成占用内存更小的第二pattren文件，提高下发效率。

本发明授权一种实现自由逻辑的pattern生成和运行方法在权利要求书中公布了：1.一种实现自由逻辑的pattern生成方法，其特征在于，包括，获取被测芯片的测试信息，基于程序语言编辑程序文本以生成第一pattern文件；上位机基于转换表将文本格式的第一pattern文件转换成机器语言形式的第二pattern文件，第二pattren文件下发至测试机； 程序语言人为设定，且程序文件由若干程序语言顺序排列构成，其中，循环检测的程序语言为：loopJudgeiRegType,iTimeout,iInterval,iRegRead,iRegCompData,resultAddr，表示对被测芯片的输出做循环比对； 其中：iRegType表示寄存器类型，0=FPGA寄存器，1=数据缓存寄存器；iTimeout表示超时判断时间；iInterval表示查询寄存器间隔时间；iRegRead表示需要读取的寄存器地址；iRegCompData:表示对比的寄存器数据；resultAddr:表示对比的执行结果缓存寄存器地址； 数据输入的程序语言为：writeRegiType,iDataType,addr,data，表示向寄存器addr地址写data数据，使data数据输入至被测芯片； 其中：iType表示FPGA或缓存，0=FPGA；1=缓存；iDataType表示数据类型；addr表示寄存器地址；data表示寄存器数据； 被测芯片的测试信息包括延时控制、条件判断、循环、寄存器读写、继电器开关切换、电压电流输出和测量指令，用户依据设定的程序语言编写，生成用于测试芯片性能的第一patter文件，能够节省第一pattren文件的内存，方便快速查看和用户修改； 上位机基于转换表将文本格式的第一pattern文件转换成机器语言形式的第二pattern文件，第二pattren文件下发至测试机，测试机包括主控单元，主控单元分别与若干用于存储输入数据、输出数据、比对数据、计时数据的功能寄存器数据互通，控制不同功能寄存器配合运行，完成芯片测试时的延时控制、条件判断、循环、寄存器读写、继电器开关切换、电压电流输出和测量指令； 转换表包括命令信息、值信息和程序语言，命令信息包括若干命令码，命令码与功能寄存器一一对应，通过命令码调取对应功能寄存器；值信息与命令码对应，控制对应功能寄存器动作；程序语言与固定格式排布的若干命令码对应；依据程序语言与命令码之间的转换关系，进行语言的转换，依据命令码与值信息之间的对应关系，进行程序语言内数据信息的转换。

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