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龙图腾网获悉芯凌特(苏州)半导体有限公司申请的专利一种基于Multi-Point CTS的芯片时钟设计优化方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119783627B 。

龙图腾网通过国家知识产权局官网在2025-09-12发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411839631.2，技术领域涉及：G06F30/396；该发明授权一种基于Multi-Point CTS的芯片时钟设计优化方法是由周康设计研发完成，并于2024-12-13向国家知识产权局提交的专利申请。

本一种基于Multi-Point CTS的芯片时钟设计优化方法在说明书摘要公布了：本发明公开了一种基于Multi‑PointCTS的芯片时钟设计优化方法，涉及芯片时钟设计优化技术领域，包括，使用硬件描述语言VHDL编写描述电路行为的RTL代码，采用Synopsys的DCEDA工具将RTL代码转换为逻辑网表，使用标准算法H‑Tree构建初步的时钟树结构布局，得到初步时钟树拓扑图；引入Multi‑PointCTS方法，采用多个时钟源对初步时钟树拓扑图进行优化，得到优化后的时钟树拓扑图；采用静态时序分析工具PrimeTime对优化后的时钟树拓扑图进行分析，得到时序分析结果；根据时序分析结果识别出优化后的时钟树拓扑图中时钟源到寄存器的最长路径，标记为关键路径，采用启发式搜索算法找到关键路径中放置缓冲器的最佳位置；再次利用PrimeTime，计算优化后的时钟树拓扑图实际延迟与最大允许延迟的差异值。

本发明授权一种基于Multi-Point CTS的芯片时钟设计优化方法在权利要求书中公布了：1.一种基于Multi-PointCTS的芯片时钟设计优化方法，其特征在于：包括， 使用硬件描述语言VHDL编写描述电路行为的RTL代码，采用Synopsys的DCEDA工具将RTL代码转换为逻辑网表，使用标准算法H-Tree构建初步的时钟树结构布局，得到初步时钟树拓扑图； 引入Multi-PointCTS方法，采用多个时钟源对初步时钟树拓扑图进行优化，得到优化后的时钟树拓扑图，具体步骤为： 选择基于区域划分和动态缓冲器插入的多点CTS策略作为优先方案； 根据初步时钟树拓扑图，将整个芯片划分为若干个子区域，每个子区域都将配置一个或多个时钟源，确定每个子区域的最佳时钟源位置，表达式为： ； 其中，为时钟源的有效性指标，和分别是积分区间的起点和终点，为距离处的负载密度函数，为距离处的时钟传输延迟微分，为时钟源数量，为第个时钟源的频率； 选取最大值的，作为每个子区域的最佳时钟源位置，并得到优化后的时钟树拓扑图； 采用静态时序分析工具PrimeTime对优化后的时钟树拓扑图进行分析，得到时序分析结果； 根据时序分析结果识别出优化后的时钟树拓扑图中时钟源到寄存器的最长路径，标记为关键路径，采用启发式搜索算法找到关键路径中放置缓冲器的最佳位置； 再次利用PrimeTime，计算优化后的时钟树拓扑图实际延迟与最大允许延迟的差异值，根据差异值调整缓冲器的位置，更新时钟树拓扑图； 对更新后的时钟树拓扑图进行功耗评估，得到功耗敏感性分析结果，依据功耗敏感性分析结果，将高功耗缓冲器替换为低功耗缓冲器； 使用Mentor的DRC工具CalibreMentor的Calibre，识别并修正更新后的时钟树拓扑图、时序分析结果以及功耗敏感性分析结果中所违反物理规则的地方，并生成芯片时钟设计优化的验证报告。

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