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龙图腾网获悉杭州雄迈集成电路技术股份有限公司申请的专利一种I2C总线的检测装置和方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN113946480B 。

龙图腾网通过国家知识产权局官网在2025-09-05发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202111396018.4，技术领域涉及：G06F11/22；该发明授权一种I2C总线的检测装置和方法是由赵虎;贺华昭;肖文勇;何利蓉设计研发完成，并于2021-11-23向国家知识产权局提交的专利申请。

本一种I2C总线的检测装置和方法在说明书摘要公布了：本发明公开了一种I2C总线的检测装置和方法，其中所述装置包括：总线状态检测模块；计数器；寄存器组；数据串并转换模块；地址对比模块；其中所述总线状态检测模块连接所述计数器，所述计数器连接所述数据串并转换模块，所述数据串并转换模块连接所述寄存器组，且所述地址对比模块连接所述寄存器组。所述装置和方法采用门级电路搭建，可以减少电路的面积，提高单位面积芯片的性能。所述装置方法无系统时钟，且为异步电路设计，可以提高模块的兼容性。

本发明授权一种I2C总线的检测装置和方法在权利要求书中公布了：1.一种I2C总线的检测方法，其特征在于，包括： 总线状态检测模块对输入数据信号下降沿采样输入时钟信号的D触发器，生成第一检测信号； 在时钟信号上升沿对所述第一检测信号采样生成第二检测信号，将所述第一检测信号和第二检测信号的取反信号相与生成初始检测信号； 时钟输出信号根据时钟SCL时钟周期进行计数输出； 复位信号和复位错误信号在拉高时对计数进行异步清零； 或当计数使能信号为高时，且参考信号为高并地址对比失败时对计数进行同步清零； 具体包括：通过输入数据串并转换模块接收cnt_scl、i_sda和i_scl信号并输出reg_data信号；通过输出数据并串转换模块接收cnt_scl、reg_data、i_scl、match和rd_match信号并输出o_sda和o_sda_en信号；通过地址对比模块接收cnt_scl、i_sda、i_scl和rs信号并输出match和rd_match信号； 通过一个i_sda下降沿采样i_scl的D触发器来检测起始信号start_cnd0，在i_scl上升沿对start_cd0采样产生start_cnd1信号；通过start_cnd0信号和start_cnd1信号的反信号相与形成start脉冲信号，start脉冲信号为实际的电路起始信号；cnt_en信号会在i_scl下降沿检测到start信号为高时拉高，在stop信号为高时异步复位；在cnt_en拉高后，cnt_scl就会在i_scl上升沿对SCL时钟周期计数，直到cnt_en为低时计数值不再增加，在rs_error信号和stop信号拉高后计数值异步清零；移位寄存器会在cnt_en为高时存入i_sda线的串行数据，在cnt_scl为8时其存储的8位数据会与自身7位从机地址加1位写比对，o_sda_en即o_sda使能信号拉高，o_sda会输出比对结果的相反值，即比对成功拉低o_sda，比对失败拉高o_sda，以此回复一个响应信号ACK或非响应信号NACK；在响应之后若rs信号未拉高则为读操作，rs信号检测方法与start信号一致，但会保持至stop为高后异步清零；在读操作时，计数为35时所选中的寄存器会被写入此时移位寄存器0的值，在回复了应答信号后，主机发送终止信号stop，完成此次寄存器配置，在下一个start信号拉高时异步清零；若rs为高则会在cnt_scl计数至36时比对移位寄存器0中的数据，比对值为自身从机地址加1位读，若比对成功，选中的配置寄存器的8位数据会在i_scl下降沿写入移位寄存器1，接下来的8个i_scl时钟周期i_sda会依次输出8个数据。

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