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龙图腾网获悉意法半导体应用有限公司申请的专利处理系统、相关的集成电路、设备和方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115408313B 。

龙图腾网通过国家知识产权局官网在2025-09-02发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202210583662.0，技术领域涉及：G06F13/28；该发明授权处理系统、相关的集成电路、设备和方法是由R·南德林格;R·科隆波设计研发完成，并于2022-05-25向国家知识产权局提交的专利申请。

本处理系统、相关的集成电路、设备和方法在说明书摘要公布了：在一个实施例中，处理系统包括经由软件指令可编程的微处理器、被配置为耦合到存储器的存储器控制器、将微处理器耦合到存储器控制器的通信系统、密码协处理器和第一通信接口。该处理系统还包括第一和第二可配置DMA通道。在第一配置中，第一DMA通道被配置为将数据从存储器传输到密码协处理器，并且第二DMA通道被配置为经由两个循环将经加密的数据从密码协处理器传输到第一通信接口。在第二配置中，第二DMA通道被配置为经由两个循环将接收到的数据从第一通信接口传输到密码协处理器，并且第一DMA通道被配置为将经解密的数据从密码协处理器传输到密码协处理器。

本发明授权处理系统、相关的集成电路、设备和方法在权利要求书中公布了：1.一种处理系统，包括： 微处理器，能够经由软件指令编程； 存储器控制器，被配置为耦合到存储器； 通信系统，将所述微处理器耦合到所述存储器控制器； 密码协处理器，包括： 多个输入数据寄存器，被配置为存储具有多个字节的第一数据块，其中所述输入数据寄存器的数目对应于寄存器的第一数目， 多个输出数据寄存器，被配置为存储第一经处理的数据块，其中所述输出数据寄存器的数目对应于寄存器的所述第一数目， 第一控制寄存器，能够由所述微处理器编程，并且被配置为存储第一配置数据， 密码处理电路，被配置为：根据被存储到所述第一控制寄存器的所述第一配置数据，处理被存储到所述输入数据寄存器的数据，并且将相应的经处理的数据存储到所述输出数据寄存器，其中所述密码处理电路被配置为：当所述经处理的数据已被存储到所述输出数据寄存器时，生成第一控制信号， 第一DMA接口电路，被配置为生成第一请求信号，所述第一请求信号通过以下操作来请求将新的第一数据块传输到所述输入数据寄存器： 根据被存储到所述第一控制寄存器的所述第一配置数据并且响应于同步信号，断言所述第一请求信号，以及 响应于第一确认信号，取消断言所述第一请求信号， 第二DMA接口电路，被配置为生成第二请求信号，所述第二请求信号通过以下操作来请求从所述输出数据寄存器传输第一经处理的数据块： 根据所述第一控制信号，断言所述第二请求信号，以及响应于第二确认信号，取消断言所述第二请求信号，其中所述第二DMA接口电路被配置为：响应于所述第二确认信号，断言所述同步信号； 第一通信接口，包括： 多个发送数据寄存器，被配置为存储具有多个字节的第二数据块，其中所述发送数据寄存器的数目对应于寄存器的第二数目， 第二控制寄存器，能够由所述微处理器编程，并且被配置为存储第二配置数据， 硬件通信接口，被配置为：根据被存储到所述第二控制寄存器的所述第二配置数据，发送被存储到所述发送数据寄存器的数据，其中所述硬件通信接口被配置为：当被存储到所述发送数据寄存器的数据已被发送时，生成第二控制信号，以及 第三DMA接口电路，被配置为生成第三请求信号，所述第三请求信号通过以下操作来请求将新的第二数据块传输到所述发送数据寄存器： 根据被存储到所述第二控制寄存器的所述第二配置数据并且响应于所述第二控制信号，断言所述第三请求信号，以及 响应于第三确认信号，取消断言所述第三请求信号； 第一DMA信道，被配置为： 响应于所述第一请求信号，向所述存储器控制器发送请求以将新的第一数据块从所述存储器传输到所述输入数据寄存器，以及 一旦已将所述新的第一数据块从所述存储器传输到所述输入数据寄存器，就断言所述第一确认信号； 第二DMA信道，被配置为： 接收初始源地址和初始目标地址，其中所述初始源地址对应于与所述输出数据寄存器中的第一寄存器相关联的地址，并且所述初始目标地址对应于与所述发送数据寄存器中的第一寄存器相关联的地址， 将源地址设置为所述初始源地址，并且将目标地址设置为所述初始目标地址， 响应于DMA请求信号，执行从所述源地址到所述目标地址的给定数目的数据传输操作，其中数据传输操作的所述给定数目对应于寄存器的所述第一数目，并且其中所述源地址和所述目标地址增加以用于每个数据传输操作， 一旦所述给定数目的数据传输操作已被执行，断言所述第二确认信号，并且将所述源地址重置为所述初始源地址，以及 断言所述第三确认信号，并且将所述目标地址重置为所述初始目标地址；以及 请求控制电路，被配置为： 响应于确定所述第二请求信号和所述第三请求信号被断言，断言所述DMA请求信号，以及 响应于确定所述第二请求信号或所述第三请求信号被取消断言，取消断言所述DMA请求信号。

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