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龙图腾网获悉清华大学申请的专利基于DAC的四电平脉冲幅度调制高速串口发射机电路获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115694527B 。

龙图腾网通过国家知识产权局官网在2025-09-02发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211293270.7，技术领域涉及：H04B1/04；该发明授权基于DAC的四电平脉冲幅度调制高速串口发射机电路是由贾海昆;林子逸;邓伟;池保勇设计研发完成，并于2022-10-21向国家知识产权局提交的专利申请。

本基于DAC的四电平脉冲幅度调制高速串口发射机电路在说明书摘要公布了：本发明提供了基于DAC的四电平脉冲幅度调制高速串口发射机电路、高速串口发射机以及电子设备，涉及集成电路设计领域。低速数字合路器接收多路并行低速不归零码数据信号对其进行合路，产生8路高速不归零码数据信号并传输至四电平脉冲幅度调制模块；四电平脉冲幅度调制模块接收8路高速不归零码数据信号，将其转换为4路四电平脉冲幅度调制信号并传输至模拟合路模块；模拟合路模块接收4路四电平脉冲幅度调制信号对其进行合路，并进行2‑tap的前馈均衡产生1路串行高速数据信号进行输出。本发明采用模拟合路器进行数据合路，同时实现前馈均衡。工作速率高、合路速率高、拓展带宽、结构简化、面积小、功耗低，减小了输出节点的寄生电容。

本发明授权基于DAC的四电平脉冲幅度调制高速串口发射机电路在权利要求书中公布了：1.一种基于DAC的四电平脉冲幅度调制高速串口发射机电路，其特征在于，所述四电平脉冲幅度调制高速串口发射机电路包括：低速数字合路器、四电平脉冲幅度调制模块、模拟合路模块以及时钟产生模块； 所述低速数字合路器接收多路并行低速不归零码数据信号，对其进行合路，产生8路高速不归零码数据信号并传输至所述四电平脉冲幅度调制模块； 所述四电平脉冲幅度调制模块接收所述8路高速不归零码数据信号，将其转换为4路四电平脉冲幅度调制信号，并传输至所述模拟合路模块； 所述模拟合路模块接收所述4路四电平脉冲幅度调制信号，对其进行合路，并进行2-tap的前馈均衡，产生1路串行高速数据信号进行输出； 所述时钟产生模块与所述低速数字合路器和所述模拟合路模块分别连接，所述时钟产生模块用于向所述低速数字合路器和所述模拟合路模块提供时钟信号； 其中，所述模拟合路模块输出的所述1路串行高速数据信号，利用电感峰化技术进行带宽扩展后再输出片外； 所述模拟合路模块包括：第一2:1模拟合路器、第二2:1模拟合路器、第一归零码产生单元、第二归零码产生单元以及归零码求和单元； 所述第一2:1模拟合路器接收所述4路四电平脉冲幅度调制信号中任意2路四电平脉冲幅度调制信号，所述第二2:1模拟合路器接收所述4路四电平脉冲幅度调制信号中剩余2路四电平脉冲幅度调制信号； 所述第一2:1模拟合路器对接收到的2路四电平脉冲幅度调制信号进行合路，得到第1路频率更高的四电平脉冲幅度调制信号并传输至所述第一归零码产生单元； 所述第二2:1模拟合路器对接收到的2路四电平脉冲幅度调制信号进行合路，得到第2路频率更高的四电平脉冲幅度调制信号并传输至所述第二归零码产生单元； 所述第一归零码产生单元将所述第1路频率更高的四电平脉冲幅度调制信号转换为第一归零码信号，并将所述第一归零码信号传输至所述归零码求和单元； 所述第二归零码产生单元将所述第2路频率更高的四电平脉冲幅度调制信号转换为第二归零码信号，并将所述第二归零码信号传输至所述归零码求和单元； 所述归零码求和单元将所述第一归零码信号和所述第二归零码信号错位相加，得到所述1路串行高速数据信号。

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