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龙图腾网获悉中山大学申请的专利高层次综合的流程布局方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN115422876B 。

龙图腾网通过国家知识产权局官网在2025-07-29发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202211039147.2，技术领域涉及：G06F30/392；该发明授权高层次综合的流程布局方法是由王自鑫;张仕杰;陈弟虎;何晓曦设计研发完成，并于2022-08-29向国家知识产权局提交的专利申请。

本高层次综合的流程布局方法在说明书摘要公布了：本发明提供的高层次综合的流程布局方法，方法包括以下步骤：获取目标电路的电路描述，根据所述电路描述构建得到所述目标电路对应的控制数据流图；所述控制数据流图为表征目标电路运算操作的有向图；通过平面规划算法对所述控制数据流图进行分割，得到布局约束；对所述控制数据流图进行调度，将调度结果进行绑定得到寄存器传输级描述；根据所述布局约束对所述寄存器传输级描述得到目标网表，根据所述目标网表确定所述目标电路的流程布局；方法通过高层次综合减少布局布线的拥塞情况，同时也能够减少布线过程中跨FPGAblock边界带来的延迟增加；可广泛应用于电路仿真技术领域。

本发明授权高层次综合的流程布局方法在权利要求书中公布了：1.高层次综合的流程布局方法，其特征在于，包括以下步骤： 获取目标电路的电路描述，根据所述电路描述构建得到所述目标电路对应的控制数据流图；所述控制数据流图为表征目标电路运算操作的有向图； 通过平面规划算法对所述控制数据流图进行分割，得到布局约束； 对所述控制数据流图进行调度，将调度结果进行绑定得到寄存器传输级描述；根据所述布局约束对所述寄存器传输级描述得到目标网表，根据所述目标网表确定所述目标电路的流程布局； 所述通过平面规划算法对所述控制数据流图进行分割，得到布局约束，包括： 获取所述电路描述中所述目标电路的FPGA架构； 根据所述控制数据流图中数据流进程对应的函数，进行编译得到寄存器转换级的电路模块； 根据所述电路模块对所述FPGA架构进行分区，确定分区结果的成本函数；通过对所述FPGA架构的分区结果进行分割迭代，确定所述成本函数为最小值或者分区中的资源到达资源约束的临界值，输出得到所述布局约束； 所述成本函数用于表征所述FPGA架构的分区边界的导线数量；所述成本函数为： 其中，C为成本值，vi以及vj表征所述控制数据流图中的节点，i＝1,2,3,…n，j＝1,2,3,…n，n为正整数，E表征节点间FIFO通道的集合，eij为vi和vj之间的连接线，row表示行数，col表示列数，width表示数据位宽。

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