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龙图腾网获悉北京轩宇信息技术有限公司申请的专利一种干扰检测FPGA的验证方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119150778B 。

龙图腾网通过国家知识产权局官网在2025-07-22发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411251567.6，技术领域涉及：G06F30/343；该发明授权一种干扰检测FPGA的验证方法是由王天夏设计研发完成，并于2024-09-08向国家知识产权局提交的专利申请。

本一种干扰检测FPGA的验证方法在说明书摘要公布了：本发明公开了一种干扰检测FPGA的验证方法，涉及干扰检测处理技术领域，步骤如下：单音干扰：步骤1：单音干扰1~单音干扰N模块：SystemVerilog语言通过设置不同频率控制字，使用DDS生成不同频率的正弦波信号，根据FPGA可接收的中频信号为中心频率，以输入信号带宽范围要求为依据设置正弦信号频率，送给N个单音干扰处理模块；步骤2：N个单音干扰处理模块：选择输入信号带宽范围内的单音信号1~N送给N选一模块。本发明解决了第三方FPGA验证人员不具备实物硬件条件的验证环境问题，解决了验证环境有无的问题，使软环境验证技术成为可能选项，验证效率大为提高。

本发明授权一种干扰检测FPGA的验证方法在权利要求书中公布了：1.一种干扰检测FPGA的验证方法，其特征在于，步骤如下： 单音干扰： 步骤1：单音干扰1~单音干扰N模块：SystemVerilog语言通过设置不同频率控制字，使用DDS生成不同频率的正弦波信号，根据FPGA可接收的中频信号为中心频率，以输入信号带宽范围要求为依据设置正弦信号频率，送给N个单音干扰处理模块； 步骤2：N个单音干扰处理模块：选择输入信号带宽范围内的单音信号1~N送给N选一模块； 步骤3：N选一模块：针对输入的N个单音信号，划分不同时段，每次选一个频点的单音信号作为当前单音干扰信号； 步骤4：加底噪模块：系统的底部噪声作为条件必须考虑，通过高斯白噪声函数$dist_normal，生成底部噪声信号，seed为0，期望为0，通过调整标准差参数获取不同功率的高斯白噪声；当前单音信号叠加上底噪信号，形成最终的单音干扰信号送给干扰检测处理FPGA进行处理； 步骤5：干扰检测处理FPGA模块：干扰检测处理FPGA完成单音干扰检测处理； 步骤6.1：干扰检测结果输出模块：该模块采集输出干扰类型，干扰频率结果原始值和干扰带宽原始值，将干扰频率结果原始值*1024Hz得到真实频率； 步骤6.2：干扰频谱结果输出模块：该模块采集经过DUT检测输出的单音干扰信号频谱数据打印并保存，送入Matlab还原其幅度谱绘图显示； 多音干扰：步骤1：单音干扰1~单音干扰N模块：SystemVerilog语言通过设置不同频率控制字，使用DDS生成不同频率的正弦波信号，根据FPGA可接收的中频信号为中心频率，以输入信号带宽范围要求为依据设置正弦信号频率，送给N个单音干扰处理模块； 步骤2：单音频率间隔设置模块：该模块设置单音信号的频率间隔，间隔大于干扰检测处理FPGA的最小分辨率时，生成若干个频率离散的单音信号，送给N个单音干扰处理模块； 步骤3：N个单音干扰处理模块：根据需要选择输入信号带宽范围内的单音信号1~N送给N选一模块； 步骤4：N选多模块：针对输入的N个离散的单音信号，划分不同时段，每次选若干个频点的单音信号作为当前的多音干扰信号； 步骤5：加底噪模块：当前多音信号叠加上底噪信号，形成最终的多音干扰信号送给干扰检测处理FPGA进行处理； 步骤6：干扰检测处理FPGA模块：干扰检测处理FPGA完成多音干扰检测处理； 步骤7.1：干扰检测结果输出模块：该模块采集输出干扰类型，干扰频率结果原始值和干扰带宽原始值，将干扰频率结果原始值*1024Hz得到真实频率； 步骤7.2：干扰频率结果输出模块：经过DUT检测输出的多音干扰信号频谱数据打印并保存，送入Matlab还原其幅度谱绘图显示。

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