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龙图腾网获悉电子科技大学申请的专利一种CIS线阵相机数据缓存方法获国家发明授权专利权，本发明授权专利权由国家知识产权局授予，授权公告号为：CN119485055B 。

龙图腾网通过国家知识产权局官网在2025-07-22发布的发明授权授权公告中获悉：该发明授权的专利申请号/专利号为：202411333427.3，技术领域涉及：H04N25/77；该发明授权一种CIS线阵相机数据缓存方法是由罗颖;阮晖雄;韩泽欣;贾宏宇设计研发完成，并于2024-09-24向国家知识产权局提交的专利申请。

本一种CIS线阵相机数据缓存方法在说明书摘要公布了：本发明公开了一种CIS线阵相机数据缓存方法，属于图像采集处理领域，特别设计一种针对CIS线阵传感器的后端数据缓冲技术。主要目的是将ADC采集到的分段图像缓存到FPGA并输出给高速接口。通过在数据写入阶段对数据顺序进行重排列，将一行完整的图像“Z”字形写入到计算好数量的若干个RAM中，并在读取阶段按顺序选择固定数量的RAM输出给后端模块。实现了ADC数据到高速接口的数据缓存和图像拼接处理，有着高速、大带宽、高实时性、高开发效率的特点。

本发明授权一种CIS线阵相机数据缓存方法在权利要求书中公布了：1.一种CIS线阵相机数据缓存方法，该方法包括： 步骤1：将ADC采集到的数据采用FIFO进行行同步以及时钟同步； 步骤2：对同步后的数据进行解串； 步骤3：将解串得到的每个Channel的数据分配到RAM的对应位置； 步骤3.1：在RAM写入阶段对数据顺序进行重排列，计算好待写入数据的RAM数量为n，这n个RAM紧密排列； 步骤3.2：将第1个数据存入RAM1，第2个数据存入RAM2，第3个数据存入RAM3，……，第n个数据存入RAMn，第n+1个数据存入RAM1，第n+2个数据存入RAM2，第n+3个数据存入RAM3，…… 按照上述方法将一行完整的图像按“Z”字形写入RAM整列中； 步骤4：缓存系统根据外部读写控制信号进行乒乓操作，保障数据完整性； 步骤5：数据读取时，按顺序选择固定数量RAM合并输出到高速接口； 所述步骤2中解串时，采用单颗有9个并行采集通道的ADC，10bit精度，第一个时钟周期并行输出1、2、3通道，第二个时钟周期输出4、5、6通道，第三个时钟周期输出7、8、9通道,……,第3m+1个时钟周期输出1、2、3通道、第3m+2个时钟周期输出4、5、6通道、第3m+3个时钟周期输出7、8、9通道，……依次循环； 用状态机控制ADC解串的过程中，状态在第3m+1个时钟周期、第3m+2个时钟周期、第3m+3个时钟周期之间循环跳转每个时钟周期状态转换一次，m＝0、1、2、3……；为了保证每个通道的数据相位同步，在第3m+1个时钟周期、第3m+2个时钟周期的状态得到的数据会锁存在寄存器中最后在第3m+3个时钟周期的状态同步输出。

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